MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
4 g+ ~. m3 Z% Y; _input mcasp_ahclkx,$ H; h) d  d; y2 e' P& g" g0 g# c" H
input mcasp_aclkx,! c- r' ?7 e+ o1 D$ g* n; H
input axr0,, o) A/ ^" i. r5 `9 j

+ @: `& e7 y5 {8 routput mcasp_afsr,
- Q& e+ G2 W" W, i1 _output mcasp_ahclkr,6 S1 `7 K2 J" [1 o8 q. ]0 c% Q
output mcasp_aclkr,
' ?; R' U1 E1 r0 H! Qoutput axr1,
# H1 e' r6 C) H
assign mcasp_afsr = mcasp_afsx;
1 p* v3 j$ _( n+ Q; Eassign mcasp_aclkr = mcasp_aclkx;, o4 C# ~8 f: v  h5 h
assign mcasp_ahclkr = mcasp_ahclkx;4 Z# G' s# d! N5 E# r
assign axr1 = axr0;
9 \$ P) T7 U# ]0 [

6 k& \( `2 H+ v( @3 q. D
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
3 P, \4 `3 `9 P; i1 t8 [; X; l
static void McASPI2SConfigure(void)
  ?+ e3 o  B5 Q) G6 S{
& L1 V( W8 o2 [! O  oMcASPRxReset(SOC_MCASP_0_CTRL_REGS);% `' x1 O5 e4 ?( d( b
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */) y$ o1 ~& ~- ^$ x
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
! s) E4 b) T. ^2 PMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
" l! J8 K! e7 p# W6 d# E' bMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,% K# i. O0 ~0 G2 ?
MCASP_RX_MODE_DMA);
, p1 @/ S( S! a* y0 JMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,/ S4 F$ x3 h* Q9 L3 y
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
: P+ y& T) |. f4 fMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ) L# f& k- A2 }! e
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
6 ]* X1 b$ l: _' c+ CMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ! J3 j" K: n  Q  C  j* V
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */8 z3 \6 `2 J1 @5 @6 A# Y
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
) j9 X) \4 j+ V0 y- Q, aMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
0 |8 f6 c4 m$ O! k1 f/ \McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
0 O% E5 g. @+ Z8 s* j! v, n2 L' o0x00, 0xFF);
/* configure the clock for transmitter */+ h2 Z, p5 o" A  F$ n7 I. L
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);4 H# G: P5 p- K7 g% |
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 0 m$ I6 u% @! Q; J7 E
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,/ u# i2 H: ~! |" g2 q% ^% m" E) e$ a
0x00, 0xFF);
% f. v% }" t& T' m$ k+ |
$ n/ P7 F8 ]) F" s' c, e/* Enable synchronization of RX and TX sections */ 4 E& E- \5 c, M& L3 ^8 K6 w
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */* j1 f" w% `1 X' j; P6 C  U
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);( ]8 f* Q0 R/ x% H" o; i
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*( Z2 V4 k& Y4 S
** Set the serializers, Currently only one serializer is set as
4 r# G7 E- W* s+ ]** transmitter and one serializer as receiver.* I* x1 i$ n: ~7 E0 [9 O; U
*/
+ w& Z7 x6 b1 [/ JMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);  [5 O0 W" f/ z
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*: Z  B- u9 F# T$ G
** Configure the McASP pins
0 v- Z. O8 S  W9 G+ o! r! i** Input - Frame Sync, Clock and Serializer Rx8 g) b* p/ T+ q+ I) |
** Output - Serializer Tx is connected to the input of the codec 6 d  T' l$ p* j# D& S+ H/ d
*/
( U) p2 {8 h+ s3 ^8 {5 eMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
7 H/ c; C& b1 E3 o4 }' u8 \McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));# m! i' X6 T7 ?% H
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
/ t8 J3 V/ n. }2 \| MCASP_PIN_ACLKX! }% e7 L  K# T  @4 c
| MCASP_PIN_AHCLKX* u' {4 F7 q% @% O
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
; m6 O" |" S4 ?5 V( K$ N0 [: u; oMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
) h1 o  B! U! ?5 g* f' ]0 u3 A- f| MCASP_TX_CLKFAIL   ^0 k# j% q) W: S8 `7 p4 D
| MCASP_TX_SYNCERROR
1 g# ~' X4 s9 }: Z| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
6 t0 D2 ]6 s; `| MCASP_RX_CLKFAIL  `$ T* p1 w: {
| MCASP_RX_SYNCERROR 4 g1 v. H& l; i' C
| MCASP_RX_OVERRUN);
' w. x) Y+ W" b- j) \1 s8 r}
static void I2SDataTxRxActivate(void)
2 N9 L7 u+ C" j2 b6 O) O! x; V{. R  R) R  S! `3 a9 F6 H# Y9 c
/* Start the clocks */4 O2 C1 H9 D+ ]" ]
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
, x! b( f, x, D1 A  K% |! [% m: L; sMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
, y2 u/ b: ~; X) J* [0 x% j4 JEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,6 t1 g9 x5 I* h3 g
EDMA3_TRIG_MODE_EVENT);; A% Q9 y# z$ |+ A2 Z& v$ l# }
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, " `  L; r, N  Y$ f' v
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */6 A* X2 }2 ~7 K0 V
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);* B0 q, U+ L! }+ k  {$ h
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
; E% {" P8 j3 T" G" w6 S& Dwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */. Y: [% W1 H$ `& {5 w; [) T7 i
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
5 c0 e( Q9 ^9 h4 jMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
4 E( R4 x! u+ `" G3 ~}
- U* i5 b, T; p
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

" v) r, u, a* x  |. G* {
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