MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,, Z7 a6 E4 T0 R5 T
input mcasp_ahclkx,8 N6 Q' ^: y0 \. N, g1 M% }
input mcasp_aclkx,
) ~! @+ _& T& {* R* w. dinput axr0,. @- K3 `5 N* L  E& Q

: n: N- p; I8 a  b7 U6 loutput mcasp_afsr,/ Y( q1 ^, P* j
output mcasp_ahclkr,* K3 N: L. u- f4 x# J) h
output mcasp_aclkr,6 c9 P7 b& t8 t: |& S" N
output axr1,' a6 n" z2 \/ d* h+ `
assign mcasp_afsr = mcasp_afsx;
4 u2 P  |; A) ?) ~* J) p% L& \assign mcasp_aclkr = mcasp_aclkx;
! `+ x% v$ w! u# t0 \5 Q: |assign mcasp_ahclkr = mcasp_ahclkx;
* S1 S3 k6 o0 n6 n) @assign axr1 = axr0;
, Z" x: D! G* A4 S" p* g
* V9 _4 M4 e- s' Z1 a4 X# i5 \
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

7 E$ d/ d# m+ p* G: _& O# }
static void McASPI2SConfigure(void); \. Q' m  g5 I) M, _4 x
{) U; |1 r8 C* m/ w1 F
McASPRxReset(SOC_MCASP_0_CTRL_REGS);8 N/ R+ b+ ]8 l, w' p* v/ {
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */$ V, R. e* C1 z* M9 e
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);* u% ]: _1 w$ L; i# c
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */( J2 ~; R& M9 p
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
8 t3 N# {9 T7 A% G* qMCASP_RX_MODE_DMA);# k# K- l1 O, n
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,- `2 M" R! r2 m  u. W+ }
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */, h* n. B/ w0 ]/ y* y! s
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, + k3 f! c1 \8 \( z4 m; i
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);: f- O6 D( s, W$ C$ ~$ x8 `
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 6 A: o5 v* y. M2 x3 C
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */2 A6 s# _( t3 z- ^# S+ l
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);4 q, W& H1 D. ]& w" ^
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
; b; e) {& d) ]4 W% C* FMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
0 X1 X  I9 [. Z& ?) K% P0 u0x00, 0xFF);
/* configure the clock for transmitter */
8 L, O$ S1 p( w: I5 P6 oMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);+ R2 {. ]; b' B. f' N
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
5 Q' [# k" ?. h, u+ \2 mMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
+ t3 U4 ~2 y. G4 N, {9 B0x00, 0xFF);3 {+ s. z3 m& w' P# c+ y0 N) o( f
4 p  t7 A" Q7 m7 u
/* Enable synchronization of RX and TX sections */
- l6 W% g- v( Y4 N7 q5 PMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */+ F4 _  h# W1 D6 C
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);, s3 B9 R$ C# ^% [- L
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
* d$ I- m% {/ }** Set the serializers, Currently only one serializer is set as
; d, b- |  ?7 l7 @6 I1 Q/ O** transmitter and one serializer as receiver.
" q0 n( A4 e! L! l*/
$ B% Y4 |4 a- x( C* ?3 oMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);' z0 P0 Z* C9 C: x, Q$ @8 y* e
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*# A4 |, k7 [8 U8 q0 j7 \
** Configure the McASP pins
8 X5 i, B4 U; i) Q& u, w( \5 P** Input - Frame Sync, Clock and Serializer Rx
- b( y& L* ~; F, t** Output - Serializer Tx is connected to the input of the codec
0 o0 i% a/ U4 N# Q' O: l9 U*/8 K% w! }4 l4 j) ^) l
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);6 C6 W1 ~/ Y/ r. M+ X; z
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
3 K% O$ Q, A+ n9 YMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX. ~0 D5 e5 f6 i9 X0 K: d, E- E% E
| MCASP_PIN_ACLKX2 v: H0 N: l9 l( T+ q
| MCASP_PIN_AHCLKX. Y5 |) A+ B! Q3 D: V8 Z
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */+ s1 c9 H) t3 L' T" \
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 9 x+ X% t8 j8 i4 C" U1 w
| MCASP_TX_CLKFAIL ' R' C- S8 F, x9 M2 h: Q
| MCASP_TX_SYNCERROR7 g0 H% Z$ K) T" `/ G; n
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 0 Z) k/ a. |+ }+ e3 p
| MCASP_RX_CLKFAIL; R1 U9 _5 K1 f+ f
| MCASP_RX_SYNCERROR . [$ ^* {. V# V, r: f  S. ?
| MCASP_RX_OVERRUN);
0 p/ c6 ?" U1 z}
static void I2SDataTxRxActivate(void)# ^" r- P1 _& R1 l
{: U/ g+ V$ f( w" {
/* Start the clocks */
: ~0 J6 k; I6 LMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
# ^3 w4 u7 S; i, n( F, w' b0 MMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */1 L* }: R. @# {5 G. F5 l
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
. c2 ]0 C4 h$ o$ xEDMA3_TRIG_MODE_EVENT);0 f! W! e) u$ O
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ; i# {. d! \( h, ?
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
- y) Q0 Q& P; e% k' I+ mMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);' p2 E- B- f, B; I, U
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
5 U4 B' [) {5 g7 ?" Ywhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
9 A0 L1 i- o3 s2 _) g  tMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);# ?. X; U% v8 D! f, B
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);; p. L0 O7 c* I# ]
}

& D2 L- w2 j, r( c. U. R
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
- l: A3 ~) L; z# J! F
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