MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,7 |% B7 p# s# {+ I+ j
input mcasp_ahclkx,+ F; m1 `, G7 m% r8 B
input mcasp_aclkx,4 v" D' L7 O( l4 ]
input axr0,
* L4 W/ M% H' s) ]% c7 }! M$ l6 r# n# s' _/ D9 d+ R
output mcasp_afsr,
9 [3 x; K9 [/ x0 loutput mcasp_ahclkr,
% q# n+ J7 x# C8 J. }8 s2 Boutput mcasp_aclkr,9 t2 w2 X. e0 B+ I7 i9 X
output axr1,7 ]0 V4 y9 U+ \& x& G, A4 O
assign mcasp_afsr = mcasp_afsx;2 L( p/ Z3 G/ K" D) O8 K
assign mcasp_aclkr = mcasp_aclkx;
5 e6 U" B2 {. N7 rassign mcasp_ahclkr = mcasp_ahclkx;, {$ A! L6 |8 f& j; r5 v+ {/ M4 _* F
assign axr1 = axr0;

2 G; Z, v# P% {# p  J8 Z& a* }$ E" o2 Z+ b4 B
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
& u. V( l* [8 w& l( u) c; Q: U
static void McASPI2SConfigure(void)
% Z. |$ A% t9 X: d2 A% E# F{" k; I& p7 G, R) Y5 l" a% b1 O
McASPRxReset(SOC_MCASP_0_CTRL_REGS);. W! o3 q2 @/ U1 K4 s
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
- l2 R8 {# Z1 {8 j1 M8 q" qMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
+ O3 M# }% R* @7 [McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
8 {( j0 ]- \; j, m) SMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
1 Z% d! m  n( b% |5 h$ dMCASP_RX_MODE_DMA);/ X+ x: @' c2 }# g, l8 a4 b# j# _
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,# P9 u4 P/ B$ ^- S& I4 i) {! W
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */2 u1 v9 m4 c: n' i0 \
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
& m3 s8 y1 F0 ^8 mMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);+ j& g. n% w+ n+ M* i2 G5 ~
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 9 J; ?. X3 k+ U/ g5 N" z
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */+ Z- I. F! Z* H/ m
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
2 g/ r( X& _7 {/ m! l( C0 eMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
' ]# q9 ^8 \8 @! ]/ b3 E$ P, ]McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,' |1 m- K4 A: x7 B
0x00, 0xFF);
/* configure the clock for transmitter */
" z+ z' }, `: N6 J, V$ cMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);% E9 h' T$ |2 B: x) A$ d
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 9 |5 _% w7 M3 Z" u% H
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
+ Z7 f; s& F. I0 X0x00, 0xFF);" r) W1 e6 s% {7 i8 y

9 u1 r2 \% O+ U* x% K$ N; G/* Enable synchronization of RX and TX sections */ 8 V  _8 w5 U$ n
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */: }! A. H9 o  e: E$ O" W1 i
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);# @. J, K$ r9 i9 M" U* U5 X; C
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
/ s  l, l; T  i; L** Set the serializers, Currently only one serializer is set as
' c) ~& K) T& R2 ^7 X** transmitter and one serializer as receiver.
, {" r5 \8 I+ W3 k9 z0 Q, ]*/3 W$ a- ?. Y, }3 \5 J
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
- ?) t+ j. A# H- m6 H# _, R8 HMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
2 \4 J/ I  u- ~2 a) T/ {5 u3 c** Configure the McASP pins
; H7 ]$ A2 L; d0 d5 s& o" w7 Y** Input - Frame Sync, Clock and Serializer Rx$ a5 C) |1 [8 t0 ?/ c3 Z8 M
** Output - Serializer Tx is connected to the input of the codec 7 G  }- ]& \: U' W. v
*/" _5 X) J% T0 E. D5 E5 P# q
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
) Z  U& a+ K( q# O. g9 K8 IMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));- Q! _6 P9 ]8 E% {* T% x. S6 U. a
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
5 Y% A& N0 Z: ?; }| MCASP_PIN_ACLKX" ?$ D, A" F2 P* B! b4 k
| MCASP_PIN_AHCLKX5 V$ H0 Q( W- ?5 S) ]" u9 i
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */7 j; A. n# X1 A& _) f
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 2 N" G  T5 l, y' U
| MCASP_TX_CLKFAIL
/ P; Z3 C$ N; t8 j0 S4 B5 G/ || MCASP_TX_SYNCERROR7 O. B7 m' G& H% F' K% j6 `. N
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 0 b: q5 H" A  H
| MCASP_RX_CLKFAIL
, [( b+ O3 S1 B) N3 _| MCASP_RX_SYNCERROR 5 s; W, Q/ f) P# F+ K
| MCASP_RX_OVERRUN);
& W4 I- B) r: e& a& E% _7 x}
static void I2SDataTxRxActivate(void)
4 C0 I1 l; g( C$ K7 b{
9 _3 {  g+ m8 u8 t# P+ c( e% d/* Start the clocks */  Y+ Z" k; \, m% z3 y3 I
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);6 d# p" l$ {( c' c* B: L: l
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
/ `$ G1 }! k" J2 HEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,2 f* c6 B  S' E
EDMA3_TRIG_MODE_EVENT);
& [4 `. h! V# S' uEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, # G( Y/ n. u) h9 O7 ^
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
4 L! R% s7 Q2 P' |McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
  h2 [: ~0 k2 h- l4 l  EMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
8 }/ q. O. R0 e9 x4 Z+ s2 F9 S- pwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
+ R3 G, h2 L4 h1 q  M" R& JMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);3 `+ @/ U% i- n; E& N! k+ R
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
0 S( |( {7 A/ O- J; {" G1 j$ S! y! S}
) t4 Z  u% K8 r
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

  a% z9 G  f# |! M
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