MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
# t* }0 H- x1 l$ j$ Tinput mcasp_ahclkx,
) \6 f" ~1 `7 O' a0 D& yinput mcasp_aclkx,# J% V8 l) ~* O
input axr0," I! [& x; L" \: c
" S' T6 @( U; I. A. }+ C1 ^7 Z/ k
output mcasp_afsr,
: H: m# ]3 }. B! f4 O# ooutput mcasp_ahclkr,
9 ?1 S% n7 `) H: Poutput mcasp_aclkr,+ R+ }$ W3 |; x( A* f! o* g
output axr1,
( u( a. P/ M8 c3 Q7 T1 p
assign mcasp_afsr = mcasp_afsx;
  A9 }* {! @7 c5 t3 N) yassign mcasp_aclkr = mcasp_aclkx;2 w3 \) X8 O/ {5 V7 v- s* j
assign mcasp_ahclkr = mcasp_ahclkx;
8 D9 M: Q8 s/ J6 L  eassign axr1 = axr0;

, y4 x9 J/ _1 u
9 j; |, O, d& U
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

- Q8 u# {4 a: m, G! @: n
static void McASPI2SConfigure(void)/ D, O$ s) E0 k
{+ N, Q7 a6 M/ U* g/ d* G1 l
McASPRxReset(SOC_MCASP_0_CTRL_REGS);8 n5 c6 z+ F# ^  G
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
6 e8 B9 [& d3 [1 \. }, VMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
2 h6 E) T0 q$ r" G9 K: u" aMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
: [: i5 k# d" hMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,* e8 n( \( |3 s! `
MCASP_RX_MODE_DMA);
2 ^' h$ n( S- O8 h( Z- M, HMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE," G+ H6 B; T+ u8 T# n% ]2 ]2 }
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
. C+ _8 C$ t" i+ ?McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
5 n+ L3 }# U0 H% F) a: x1 BMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
' }. Y& V2 q1 E) `3 A. o8 D) u' ~McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
: b" D% K+ T3 G4 H: y0 ^MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
& u9 ~3 G+ Z, P" y2 ZMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
3 O# X0 W% R& s) G8 o) fMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
2 \. X1 \2 O, [0 ]4 a- d0 nMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,9 P. {+ {* \7 L+ Y
0x00, 0xFF);
/* configure the clock for transmitter */7 z$ D! {: @7 X! P8 i
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
+ R+ S' ~2 X( k" G" MMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
+ `9 p" N' i+ uMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
  R1 H) D7 c; l) h0x00, 0xFF);
# U% X. O# V- d: V
5 w- o0 Q; U( \! j; I: c/* Enable synchronization of RX and TX sections */
; S3 Y* y) ?# G# }3 x+ C% WMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */4 r8 p) j5 o* o' {4 l  ?: i
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
; G0 y4 S/ \" U2 n- j# O% {McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
* s1 ^- q4 A/ E5 ?** Set the serializers, Currently only one serializer is set as1 ~. x5 x! y( F) z# A9 ^. ^
** transmitter and one serializer as receiver.0 {, e% @4 x3 r1 }1 v
*/
3 P! C' B: X# Q' dMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
; Q5 P4 |( `  H5 KMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
% q- m, ?% a3 ?8 H9 Z) N5 z** Configure the McASP pins , {; c0 ~) o: F, S9 z' W
** Input - Frame Sync, Clock and Serializer Rx
) r* T, G$ l. ^' Y- F( y9 z** Output - Serializer Tx is connected to the input of the codec . D. [7 ~: a+ {8 p
*/
% W1 M- b0 f, v0 M  _McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
3 q+ _& L% l3 s" J$ DMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));% _. |3 h0 p- y& C9 u; J0 \0 a! z
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
+ K8 W" \2 n0 I- {2 R- u| MCASP_PIN_ACLKX
" k2 V0 g8 B$ L, p/ V! @0 X' L0 `| MCASP_PIN_AHCLKX
* ]. k5 V, m7 O6 A# b8 @| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
8 J- i( W' f: F3 s- qMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR   Y3 d* V! H2 o; _" [
| MCASP_TX_CLKFAIL
: P- K7 j0 b3 T* R* r1 h8 G+ m( o# }| MCASP_TX_SYNCERROR
1 r5 T: c: S2 {3 {: I| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
" w/ O9 {4 |: _/ T5 j, `! W| MCASP_RX_CLKFAIL
9 L. r  v# ?4 l1 G6 t| MCASP_RX_SYNCERROR
# H! P& n" i& m2 S| MCASP_RX_OVERRUN);9 [, j8 N1 p- o2 M7 M6 b2 I
}
static void I2SDataTxRxActivate(void)& r# M7 F5 n5 ]/ n7 A
{! x! l2 B) d2 b
/* Start the clocks */% L! K0 E, c% k* ~
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
( g# Q' O4 }8 C% h4 a/ lMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
4 ~3 @) v! G% x% ]7 z, a  j3 [* YEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,# a* }3 _& _; _9 X- g
EDMA3_TRIG_MODE_EVENT);
% T# a9 O' H3 `& s  FEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
6 ~% i. t' q# m( F  _6 N6 b& PEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
: {/ ]5 R) j) w' B# ~' ]McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
# C  `6 d8 u/ X' R8 L3 x1 C0 p. FMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */( m& {0 U* U: n! T7 c
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */4 U1 d3 x9 |4 o6 `5 ~
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
7 M, J3 s: Z$ A/ M7 r1 GMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);1 K5 V% f% k2 R3 m! R; K; B
}

2 Y+ ?% D7 V4 b1 _
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

' c- @7 b; P, N* V
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