MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
1 W3 L/ ^) N$ y, C$ p, e/ yinput mcasp_ahclkx,
' h8 s" o& O# qinput mcasp_aclkx,; p% o  u5 ]9 g3 f8 ]' l
input axr0,' G/ h; ]) Z5 W5 x

. v9 `# K; n+ Soutput mcasp_afsr,
0 ]* {/ `6 N' l1 }" W; doutput mcasp_ahclkr,* ]* P% W4 `2 F6 ^' h
output mcasp_aclkr,6 ]- A; P$ w3 S$ t) r
output axr1,# F" d" I5 o  ?% r$ s# |4 h' Y2 t
assign mcasp_afsr = mcasp_afsx;
) k4 z/ z- |* e- R3 Z# K# F5 ]assign mcasp_aclkr = mcasp_aclkx;
* b* i) y! i+ i' z$ u& R$ [6 l& xassign mcasp_ahclkr = mcasp_ahclkx;
: I3 j8 Y& N7 }- G! A' yassign axr1 = axr0;
7 q2 _/ k! i. W* o' X8 M8 I4 M

; s& W  A7 m. n6 X$ f; a" q
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
* `! y7 [! k2 O  X1 _& B8 k- n
static void McASPI2SConfigure(void)
* {- z, H$ i) Q$ [  a4 G{
6 m! ~1 T& [3 @* E1 p2 M# n, l0 dMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
& i  L9 @: d- W+ l' Y( bMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
. P. u' u0 t& E' U3 fMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
, b, O: s) Y. S- w6 `( UMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
0 C" R( ~  Z* \  y0 M9 {McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
; b+ g0 x: H' z) z0 n/ L7 eMCASP_RX_MODE_DMA);
7 V- v; ?" e# N7 rMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,: k& u# c* w8 Q+ i4 o
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
6 ~+ N) t+ {5 U: B7 A+ hMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
$ G! ?8 Q2 ~5 }  v& u% WMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);. i2 D/ y- _8 r$ g- u
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 7 ]6 F: r( {6 P4 Q* T
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
" w! s) B3 P" y1 a* f( EMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);% W& }) e3 Q) O# Z
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 7 o! a) H9 A, R9 Q7 `! y
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
8 g9 J% J* J1 R4 O6 z! k0x00, 0xFF);
/* configure the clock for transmitter */& H1 G: `* `; F% z/ s5 H
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);( @& r0 D/ Y' V5 o
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
4 u3 Q6 w& G; Z7 T5 SMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
1 J7 e- m' _1 W) @( I0x00, 0xFF);
/ z; K; ?% [) G* c- A. d1 j: W" x
$ a  M9 s* u% v/ h- _8 n+ f& w: D' ^/* Enable synchronization of RX and TX sections */
8 C& X8 s3 N  NMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */! m8 h, q3 `0 O/ d
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);7 l  G8 F2 h' N% i
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*. O  P# Q7 g3 q; s
** Set the serializers, Currently only one serializer is set as( N$ Z: X4 [' L
** transmitter and one serializer as receiver.
% w1 C0 w% Y2 f4 ^*/
& a! u0 [; z4 w9 q& J9 UMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
+ S( x# {0 g$ t$ @6 PMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
6 V& {) B+ u" e3 `% y* U- y** Configure the McASP pins * I/ n- Q1 V- J( `, }, K
** Input - Frame Sync, Clock and Serializer Rx
0 H, }* A0 q! f** Output - Serializer Tx is connected to the input of the codec
2 R2 W3 e" U" p' _*/- X; g  S7 b9 F' i! s# z; h) U
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);3 V* F! y, i: G$ @8 d8 v
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));& M! x& V* X  f1 o7 L7 N) a  Y
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
! t- h! j6 T" J' i. i| MCASP_PIN_ACLKX
" ^) z. D) m) U) p| MCASP_PIN_AHCLKX' H1 W, U  w: U! y5 ?
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
0 t4 ~1 Y: G  p* ]2 f# g$ _% VMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR $ C6 p0 G7 I7 h
| MCASP_TX_CLKFAIL
/ ~+ d4 J; n& h+ F0 N2 a| MCASP_TX_SYNCERROR
8 @0 `* Y9 \. u, V# X| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR ! J8 x5 p+ l4 ?' t6 T
| MCASP_RX_CLKFAIL7 g( i4 U9 M4 ^; w( b
| MCASP_RX_SYNCERROR * i! I( Z3 ?" z5 h1 V( B# h
| MCASP_RX_OVERRUN);
( ~. K' W* }. S* p# y3 C}
static void I2SDataTxRxActivate(void), }5 ^2 K4 b# h: M
{+ u' d$ P- ^9 P, g6 Z+ F- y, k6 ^5 ?
/* Start the clocks */
1 I- ?1 f& W7 A# YMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);2 g5 N' s5 i% |
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
) g/ ~" ]; m1 h, Z8 \3 QEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,' Y: t4 U/ o- h% O" |' {
EDMA3_TRIG_MODE_EVENT);
+ ?2 b' m- r, m" n6 k2 v6 HEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ; m7 j. ^7 O2 K
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
1 [! ^8 `  O7 J* Q+ R# uMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
: r) C1 X6 x( n1 xMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
- z( j9 {, Y* R9 f# r- gwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */$ S, r1 T& h/ ?: Q* r, |
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);$ Z' |$ z. j3 {) {3 O7 }2 Y  h6 y% `6 T; X
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
. B' f) i  o8 x}
- s& @/ o" m& u9 ?
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

1 {# p- C2 Y5 C0 J+ {/ B4 V
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