MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx," C6 O# W  ?( P! f6 ~5 i& E
input mcasp_ahclkx,
% Q/ x% c/ h& ~( f( g6 T5 a0 Ainput mcasp_aclkx,
3 r3 B  U# [6 ninput axr0,
8 i. U- u  U9 @9 T9 }/ o5 F9 J: a) j+ R% M5 h9 P" F/ R
output mcasp_afsr,
6 ]: U! G  ?' F. Voutput mcasp_ahclkr,
) S8 J, i* o7 J& Soutput mcasp_aclkr,% y3 u# x* M3 H0 H7 C  |
output axr1,; q+ T+ q, u  Y3 m
assign mcasp_afsr = mcasp_afsx;
' J- q1 U- u+ J1 Wassign mcasp_aclkr = mcasp_aclkx;* M6 F( e* _/ l
assign mcasp_ahclkr = mcasp_ahclkx;
) z, V& g9 ]) n/ Sassign axr1 = axr0;
, P; b) S& Z: k5 O6 W
9 z8 a; I) G  o# M* j- ]
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

8 j; T( k' P2 \$ W
static void McASPI2SConfigure(void)9 H3 c4 y5 S5 ^: m' t/ }
{
8 ], l8 @# Y. n9 X5 WMcASPRxReset(SOC_MCASP_0_CTRL_REGS);: {  D6 A+ B1 o
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
! B5 d6 }2 s$ Z9 o3 `3 k' oMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);) p/ B. m2 _: @* L3 \* ^; y( B
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
; U$ I6 g! R; Z/ V9 J* t/ NMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,% m- d4 |9 S2 Y" Y) d1 }
MCASP_RX_MODE_DMA);, |* k" j9 p/ q* ~
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
) Y* U: I9 Z+ o! r6 e0 _/ o% z. ~MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
. |9 T- K# Y& E, `  ^% tMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, * K- x3 o: i; ~4 a) R
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);3 |! {) c! U. g$ n" X7 _
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
# T/ w' @( z3 C+ J/ j& AMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
0 e+ \* X/ Y5 @& G3 T  PMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
4 P% C4 h2 u3 N1 eMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); / Y, B; @' }' {3 A6 f4 |
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,. j; y/ Y  x# f4 o% G0 G
0x00, 0xFF);
/* configure the clock for transmitter */; J; _: A& e- ^: }$ M" l
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
  h  f9 L; W  FMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
* P2 |  V) h# }6 I- f  {McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,. N& f1 K- m. `+ m4 C
0x00, 0xFF);' t) L9 n; w& w6 {3 ^; q

% ~7 m# f% G+ m4 e! Z: x9 @3 i/* Enable synchronization of RX and TX sections */
* {* e0 u9 \8 g* a9 h' \McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */# \9 }# k1 V7 n% k4 E
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
: |+ a9 b+ M  E/ s/ {) qMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
! S0 Q% h+ i  c** Set the serializers, Currently only one serializer is set as7 t; l$ N+ ^% t7 |3 Q! x0 N
** transmitter and one serializer as receiver.
6 h& z+ }0 A, a* S0 E6 v$ N: W8 o*/! i) r- _, B$ P2 I; L  U
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);8 A7 q( S+ z4 D5 q
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*: J0 @2 l! [, K& G7 p+ j% r0 v
** Configure the McASP pins
0 _- K0 e+ {2 W: ?2 e. x  ?** Input - Frame Sync, Clock and Serializer Rx
( b: M/ \% B! x) ~. m3 A** Output - Serializer Tx is connected to the input of the codec
# p0 ~  t+ ^$ v. v*/. ~8 u1 c2 S% C3 N
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);+ Q6 t) P- n- Z% r; S* h+ t+ L
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
; T! t* d# i$ a$ x; OMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX0 j, G! Q/ i$ t+ v
| MCASP_PIN_ACLKX) p; b" A6 G: G. h  |
| MCASP_PIN_AHCLKX
8 e. C" s& \6 x2 P) ^, l. B0 R| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
8 L5 T8 G7 Y; sMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
5 X* q8 @0 z0 H3 T8 k9 [0 W/ {| MCASP_TX_CLKFAIL 4 J3 {. g$ M" h. E' \& Z+ w( Q
| MCASP_TX_SYNCERROR
' k) F, S- }% _  [, G| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
  z2 |2 X+ q3 p7 p7 a0 _' L| MCASP_RX_CLKFAIL
2 c! s, J' v: l' Z9 X5 ]3 E; N| MCASP_RX_SYNCERROR / ]  K& J' V* a% `  s4 i
| MCASP_RX_OVERRUN);
5 d; r# V9 H8 ~}
static void I2SDataTxRxActivate(void)
1 d: t: ^/ {# T/ x! ^{
! {0 @0 L0 q2 i  @# {+ d/* Start the clocks */
9 L, l5 ^4 D% n7 b( v: F$ F7 o- MMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
& ~) i, c7 \" a5 H0 G4 y1 {! [McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */9 T& P" O/ D7 y: r
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,, ?. `& ~: f- v; E
EDMA3_TRIG_MODE_EVENT);
" ?9 m% @' U' J- s. XEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ! E3 g7 M, m3 p: T
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */5 A; J( n* w- S% g! }( b" Q' |
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);. O( ^/ x  h+ K% D, U
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */9 a1 ~. e7 x6 U4 v3 F' |$ y* w7 z
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
, b5 F4 L, J) N+ @9 ]% sMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
' C1 D8 v2 _+ J! r1 ]# jMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
- m0 A/ _9 R4 p6 d+ I  n6 V}

. w4 @4 B0 L% u9 R/ E2 A2 C
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

0 }' y; R  o5 n2 c
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