MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
5 u* r7 [, l! v6 D$ A) @. Zinput mcasp_ahclkx,
/ w6 Z1 V/ z6 E. Dinput mcasp_aclkx,
8 D3 [- p# N1 E% t1 Ninput axr0,4 h/ `& C4 G" m% `1 M
" [; N$ \& j2 E/ X  [! V7 j
output mcasp_afsr,8 y" a- p* e; t3 ?
output mcasp_ahclkr,( x6 w8 J% E% u9 J" N( t
output mcasp_aclkr,+ k3 n4 s, S6 r% `$ C) @
output axr1,9 J9 ]' m/ k& V3 G
assign mcasp_afsr = mcasp_afsx;7 k5 ]& t+ j! I' g3 \
assign mcasp_aclkr = mcasp_aclkx;
/ ]% S3 ?- O3 z/ M. @5 ?% B) p6 M/ I8 Oassign mcasp_ahclkr = mcasp_ahclkx;
$ \+ `3 `: l- wassign axr1 = axr0;
* C$ P2 ~4 _$ x& T) L

1 K9 K: m+ t  x2 [3 O7 G  k
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
% k& G  Z4 R' I1 D; }6 F, _4 s# d
static void McASPI2SConfigure(void)9 h2 M; z% l8 C, t) U2 A$ ?4 |3 W
{
# C9 J: ?- f) V) V* ~- W) OMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
. m/ T' A( E) h4 ]McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
- N' o3 u! ?& F) JMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/ P% Y4 L- {+ p1 Q: zMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */& Q, B& T( x6 @( ~1 n2 ]& d
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,  R* ^1 ]' r' V2 O- i
MCASP_RX_MODE_DMA);! h( |. q) H. s. i9 }
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,+ v. Q2 O  S- I6 @8 E; d
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */. t# S1 s1 S( O9 l( F0 d2 Z
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 7 e, y6 F$ e) O" a
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
2 F+ N+ I8 I/ FMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
( j& c& q/ c3 C3 sMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */8 G/ O- r2 |: j- V/ J  g1 j# |
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
8 r/ M+ H% I# n& p5 z& Q2 g" EMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
' K( @7 f) }) h5 P. ZMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32," ?$ a% D5 X9 v* F) h" Q
0x00, 0xFF);
/* configure the clock for transmitter */
# O; s. {8 Y1 F. J  [" n$ mMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
" R1 x. k4 H; i, m' v& H% K' FMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 1 ]9 i: O- x  y+ J, i
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
5 y; l' \& P# l7 s$ v7 V7 ]0 c( w) s0x00, 0xFF);- ]) i* Q2 G9 K* n

2 M1 x' V) }0 W, s& ]  P/* Enable synchronization of RX and TX sections */ : }. }8 ^2 M) I) d! c) b
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
) f- w0 E7 X: G* g2 XMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
8 N1 ~' L  x" }7 X0 f# w) F% y% Y$ @9 AMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
& {7 j. C( B. Z  ]** Set the serializers, Currently only one serializer is set as
, g/ T' Z8 P* p% c& i5 E+ y2 a7 x+ M** transmitter and one serializer as receiver.0 Q4 ?1 n( @. I" G
*/
( l9 w# P% @5 r) p" AMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);4 {5 f/ N3 J3 x
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*# i/ x! B3 h& K' d
** Configure the McASP pins
0 g' X( p/ z0 m1 W$ Y** Input - Frame Sync, Clock and Serializer Rx/ b3 q6 k. l( y# j
** Output - Serializer Tx is connected to the input of the codec , b6 L4 F$ U1 i' w* t  z( W
*/
( d* S" l0 I* P" V. KMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);  k6 T5 M) c2 l: ?" ]3 _' K6 U
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));- ?" C! Q) f0 C
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX' E# a4 a4 s. ?
| MCASP_PIN_ACLKX# P) y. A3 H% f. ]
| MCASP_PIN_AHCLKX8 j( x+ v/ |5 D6 A+ A4 v
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */+ p; s/ o7 ^2 U$ k) R$ U& E
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
" W) }4 H* F5 g| MCASP_TX_CLKFAIL
- x/ I# d; O1 {: I. O| MCASP_TX_SYNCERROR2 g$ h0 r- o$ M
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
  h; d( i; \0 A9 n, E| MCASP_RX_CLKFAIL
3 G0 r1 P/ N( R7 H5 O| MCASP_RX_SYNCERROR . `7 N& h$ ?* e8 G4 d; P6 {% c
| MCASP_RX_OVERRUN);
, D5 v9 B0 K+ R! e9 v  q6 p}
static void I2SDataTxRxActivate(void)
- u, f- t; V6 X* {{, p, }) w: |- ?0 I2 j9 o
/* Start the clocks */
  T7 ^" [0 @) ?7 y; WMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
- j. t. V, o$ D0 _1 I, a- g& wMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
# F. x/ K0 o' t9 \" K3 gEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
# C/ d4 U) C& m! _EDMA3_TRIG_MODE_EVENT);5 q: [9 v# A5 t
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
6 t1 P% y& ?7 A2 q( p; D5 W! c3 i% DEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
" }, C3 j0 F* t3 NMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);0 G. i3 N+ z  g/ `) @
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
0 C4 K, w% f. a8 n8 Fwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
. I# D7 O2 O: ?4 S+ I7 ~McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
" j9 g; H9 S) }McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
. h3 Q. s: T4 @}

* K6 Q, A6 d9 p( f: I! ]
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
+ w8 h5 X& B4 K; _
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