MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,- j. E. ]4 E4 I) _  R: ]. Q
input mcasp_ahclkx,
8 A2 A+ F: O; t' hinput mcasp_aclkx,
) [& S: y+ ~( j/ s% I1 W( K/ _+ a. [input axr0,
# Q7 \8 u+ p. G! Y0 T9 S
+ |8 F5 G4 Z1 O7 {; Q- Moutput mcasp_afsr,3 k5 u' t7 t1 {
output mcasp_ahclkr,
- z3 g7 }3 E5 m. b; c% g! Zoutput mcasp_aclkr,# {  G- F( w0 x: W/ r
output axr1,% K  O. j" a4 b( @, `4 N( j
assign mcasp_afsr = mcasp_afsx;  Q/ z* b1 t# ~4 J$ z
assign mcasp_aclkr = mcasp_aclkx;
' j' m4 {0 V1 ?$ \* C3 F, V2 vassign mcasp_ahclkr = mcasp_ahclkx;! J0 f  }8 P& z, _9 k, ^: R
assign axr1 = axr0;
% ?1 b) }+ V0 p) R0 E8 @( u0 _5 y

0 ?3 p+ v! e- x
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

% o( |3 B/ L' Z- j! v0 ?* |, X
static void McASPI2SConfigure(void)
3 b$ ~; ?0 r0 E* a{
& P7 K; f0 U+ i2 Z0 D+ yMcASPRxReset(SOC_MCASP_0_CTRL_REGS);+ r& k$ [" V" S( ]2 S9 A
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
% `* I' ]  \& `' \McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
) b' k- N; `: x5 EMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */) w) Z- j6 s3 C% l/ V0 S
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
; U! c+ h1 s$ [7 B  ]MCASP_RX_MODE_DMA);
4 K5 Z4 h: \9 b. bMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
+ e+ g' e6 _/ J+ JMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
* Q4 @: `* V2 l8 bMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 7 }5 O& X: P  ~- z3 r* O
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
9 }3 R1 r; m9 S. yMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
7 {+ R8 M3 |/ `* z% cMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
9 g4 r. C3 A( x8 S  v% I7 }0 ^: kMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);8 h  C: E/ H! o! }# ~1 V+ w9 g
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 1 M3 C. X5 O! I9 d- U
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,! }1 [, j5 D. y, n- R
0x00, 0xFF);
/* configure the clock for transmitter */, ?/ c6 p9 c5 \6 R9 g9 T7 X2 q
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
% ]' n: B: b1 a# M$ HMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); ' @" b; M+ ]* @& h5 Q$ {
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,2 l3 ^% j! |- x. {* j# v
0x00, 0xFF);
0 n% [- S- y" ~: F% V! Q: H! T2 i9 K& R+ |% w2 u
/* Enable synchronization of RX and TX sections */ & M( G, l) \) `1 D
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */$ |/ q" K# `" ]7 B
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);2 ^7 ~* I- D& t4 T' ]4 m
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
2 A" i- ~0 J" c& u1 T# ^** Set the serializers, Currently only one serializer is set as2 E% [4 {, ~$ H7 @# F
** transmitter and one serializer as receiver.
* K8 s2 N/ h6 G4 ?*/
- j' O2 N# l' T" w4 `8 b; a5 j- I( HMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);8 E1 \3 u0 e7 ~& v: T) E
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*4 ?5 I/ {1 C* j$ {$ S8 f/ i
** Configure the McASP pins
6 f$ ?+ s$ d  M" v* t, A% X5 s6 j5 {** Input - Frame Sync, Clock and Serializer Rx, @) _! q$ |1 a& T
** Output - Serializer Tx is connected to the input of the codec 1 s  c2 u" Y$ m7 G1 s
*/
- a+ E. p, S0 t4 e6 vMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
7 i. h+ A* B8 G/ @McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));+ c% T6 a; _5 V0 d3 x. H
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX! B8 y, N" v+ C) {3 D# v% N
| MCASP_PIN_ACLKX1 x* z& D4 T2 Z3 T' x8 W+ ]$ W( w
| MCASP_PIN_AHCLKX
1 C7 e9 t3 b0 X| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
  x0 D8 o7 V, q; X' @4 OMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 9 e7 L( m& B# R6 u$ [$ j4 j& I. d0 q
| MCASP_TX_CLKFAIL
5 B( t7 r  O* c* t7 K| MCASP_TX_SYNCERROR
; ^* [' t9 X5 j5 W3 l| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
' l' h" r; W) m| MCASP_RX_CLKFAIL3 D* C4 _+ D- d9 E$ k
| MCASP_RX_SYNCERROR
( H1 ?# y' Q8 p: w# o. L| MCASP_RX_OVERRUN);5 _& D8 @- i. y0 c
}
static void I2SDataTxRxActivate(void)0 L6 a& c# O" l1 H2 {) L2 @
{  n6 X2 c3 a5 ^( |" X( B
/* Start the clocks */2 W& B7 J. G4 ^8 x+ Y
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
' E  C1 t9 M( ^5 bMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
  h1 ^% l4 e+ @# ~EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
5 v6 D- E) J) \# O4 JEDMA3_TRIG_MODE_EVENT);
0 X, t  \% O0 o! |  DEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
5 p4 T/ z- C- `! R1 `4 JEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */# H: t- I* T. ?3 h$ E! O
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);' C4 V& u" B/ h
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
  ^; l, ~! Q2 x9 a1 J/ f8 \* l) Awhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
& Q9 _" l8 V) d6 J8 CMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);' J5 c9 O5 t6 F/ r, ~
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
7 |! h4 l. z* U8 F7 u' F}
2 M5 @3 _! w: I, F
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
6 R& `/ {: E% A9 L
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