MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
0 s8 {) N* ~# l: l9 l( {$ j' P) xinput mcasp_ahclkx,* I8 u, B7 {7 h. t; k
input mcasp_aclkx,
4 Q% A" f, Q8 ^" \4 jinput axr0,
' J- ]; \% R6 d$ J0 t" T: S4 k
) k! _4 g5 J+ d* S" Xoutput mcasp_afsr,
% l' J; I$ F* h; p/ I$ Soutput mcasp_ahclkr,. @+ Z4 l8 g) z, z% j; I$ W  ^5 Q
output mcasp_aclkr,
- a1 }$ Z& V5 A5 i" P! Ioutput axr1,* s: V# C% y9 {: F
assign mcasp_afsr = mcasp_afsx;
6 y% D% y: v* ~  O& a$ A) ^% rassign mcasp_aclkr = mcasp_aclkx;2 k' D# t9 `' C( p; F
assign mcasp_ahclkr = mcasp_ahclkx;
$ k- M& G( i' K: Sassign axr1 = axr0;
3 x  y, S% N% r9 z7 A( ~
4 v) ?  T& t' _
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

2 a" m" S( o: S% t" h  K! U
static void McASPI2SConfigure(void)
# s# y8 F5 X% ?+ N) V8 y{+ B' K0 Y8 c: g4 V, B
McASPRxReset(SOC_MCASP_0_CTRL_REGS);0 D0 L5 ~. i. c) V. k* L
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
# w+ y& k# U0 J. kMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);+ |9 W1 w3 c8 @7 x5 I# y$ o! L
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */$ b$ F. L) G  a6 M4 L/ g; L; S% S
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,9 l: d1 m: O) h7 e
MCASP_RX_MODE_DMA);: j6 S7 |- o4 O% B
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,' S+ h! w! o' E9 H* A
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */) ?; s3 N/ d0 D# S& t* R2 L* b! X
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 9 w0 Y" _0 c" C7 F! y
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);; g' V9 s. s" c) H, u( t/ v2 V
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 2 E. D) k' ?0 h. q
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
. s+ D6 j% k, t1 ]McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);- N- i7 r( e# ]
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
2 K; J' }) {0 T1 yMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,: j4 k5 D2 x/ o1 D3 F4 T+ N
0x00, 0xFF);
/* configure the clock for transmitter */7 S! ^' x( I5 G) \- Q
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);" K3 T  M: r; N
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);   x/ X* F9 j8 `: g! X
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
% O: k$ E  s$ U: p6 Q* }4 K+ C$ H0x00, 0xFF);
; ^" c# g) @/ j( h2 {
. ?8 F9 o& Y4 K/ n8 Y/ E/* Enable synchronization of RX and TX sections */
- C9 h& J5 B+ \4 k6 Q! v' _McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
  S; o$ L8 {7 |! h- D0 }McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);0 f& g9 F; l3 o: u2 X( D2 Q
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*2 [. d* Y! B+ ?3 b1 h
** Set the serializers, Currently only one serializer is set as/ d' ]/ ?1 ~  T0 W, M1 q' _* N
** transmitter and one serializer as receiver.
6 y# a# W' v% i0 [( M4 m* z*/; t; y) U# m: w2 g. s% p
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);3 S* x1 c5 _, G; M4 f9 j; j! z
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
, |& n# I! W6 F* j: B** Configure the McASP pins
; Q2 f! e1 J7 q' }** Input - Frame Sync, Clock and Serializer Rx! I# l4 R7 ]' z1 q
** Output - Serializer Tx is connected to the input of the codec % ]+ I5 w! D8 i$ Y1 G6 R) E, ^
*/
* d9 D, N: B1 X& NMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);4 Z" t% @; @& }* I6 y
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));0 z, t. ^& ]8 G, p* I. S
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX, s* O& U: T! ~
| MCASP_PIN_ACLKX
6 O! y  H; x2 T& _, Q1 d8 A| MCASP_PIN_AHCLKX
3 {! [4 K  f1 ~+ K6 a% B| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */* i# C9 \. S" _& q
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
% Q3 h. c+ k( L7 {! x; F$ H| MCASP_TX_CLKFAIL ( V8 b7 p7 \/ E$ ?
| MCASP_TX_SYNCERROR9 d$ d# R; X0 C7 j, U/ L
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR & w" T! ]' A8 j) r0 m3 e
| MCASP_RX_CLKFAIL
/ O, W1 s. l; K$ K8 b) q9 Q| MCASP_RX_SYNCERROR $ E/ k+ m4 `: J5 u$ E- C
| MCASP_RX_OVERRUN);2 z7 R2 {, b8 S
}
static void I2SDataTxRxActivate(void)- u  E# Y( u% b6 \, m& k
{
2 L! |% g+ K3 M$ l2 `* r/* Start the clocks */
& i2 {  w& ?% w# r( FMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);0 E6 d. D* k' R3 h* B
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */8 |; j. T  n* \5 J9 `- f
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,+ ^5 Y; s! a: T& ^" n
EDMA3_TRIG_MODE_EVENT);+ J+ q/ Q1 R1 O+ \
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, / V* i8 d+ r2 ]$ i: o  u  k/ B
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
+ o* p: [; Q' HMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);( t" z$ A$ D! `% z" T+ I3 y: M6 m
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
1 u# g! |. t$ Y# n/ J+ z& dwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */, ?4 u% @8 l1 }% _
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
: P; b; M( X! u9 l) vMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
. z2 k- u! N0 a}
9 I  d4 }& q2 a# q- M& o$ E
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

" b/ L9 M, k$ G" f
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