MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,) ?: f+ P' K- p4 b* L
input mcasp_ahclkx,2 b8 X7 @8 x) _6 I& [  W6 ]* T
input mcasp_aclkx,# f6 R) }8 p/ L1 \4 _8 K: U
input axr0,
' v8 x" a- N6 S" _- S; _
3 L! K- w' L6 x) q8 O* Poutput mcasp_afsr,
4 K# P/ `" _6 s  d# eoutput mcasp_ahclkr,
  l$ K3 A6 W/ P' L. Joutput mcasp_aclkr,
% j& E% T: L9 K, H) A8 doutput axr1,
) }- v4 t5 z; _2 x1 {# \
assign mcasp_afsr = mcasp_afsx;
# [$ A6 n" l! C8 l% h" `assign mcasp_aclkr = mcasp_aclkx;
5 x; A  }7 c$ @0 H5 m) vassign mcasp_ahclkr = mcasp_ahclkx;, P  f- T5 W) P7 h1 ]2 H
assign axr1 = axr0;

  B( U* ]8 o. H# W$ Y7 P; _$ J% H$ K0 P% c
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

( b8 F) B+ U' n) v- T3 C: k  x7 e9 z
static void McASPI2SConfigure(void)
7 l" P# G9 k; m" l. A* J% B{
/ N: E1 a7 R; A8 f+ _  o- UMcASPRxReset(SOC_MCASP_0_CTRL_REGS);: ^1 d0 Q1 u) B; t" z+ z+ w; C
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
9 r( S+ J8 r+ \; r3 y8 p! I. ZMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);8 K# x2 E  l  u: R7 v" W* i5 J
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
3 R" G0 X% V3 b& ?5 V( SMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,1 r( y, d; ^8 Y& u+ P0 c6 @
MCASP_RX_MODE_DMA);
2 b0 x* e( s9 P5 [$ ^McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
, t. l/ M" n7 O/ w. Y7 L+ p2 l% wMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */& [+ e( H0 N9 r: ^" E7 L
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 8 T# b1 ]" e3 Q0 g& \# L
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);9 A! Y; m$ P6 {1 f
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ( S' C; _5 \9 i8 F* u- y
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */5 b5 \; k/ y- }/ \8 q
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);+ c& S/ |* c( s/ }) V
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); / x  G3 M$ i+ G4 L# t& D7 ^
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
, Q: ~# w0 J. X5 W" F* j0x00, 0xFF);
/* configure the clock for transmitter */
% m- {; C3 s+ }3 u( qMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
1 e2 R' }( S/ h5 ~" uMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); + s; h0 b5 z' p
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
+ w" {' O/ r9 |- D0x00, 0xFF);
  W( O& T+ i  t+ D7 C  h3 N8 z2 x8 N, M% Y: n2 ]0 w
/* Enable synchronization of RX and TX sections */ % [& c1 O; F  i; e
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */  t& s3 U' K$ |0 V6 c' ~2 J# n
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);" _; F0 N6 N) o$ j, c+ e
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*9 A& h' Q: {# t
** Set the serializers, Currently only one serializer is set as
; P$ D: `' z5 O4 o2 i+ O3 T9 Q** transmitter and one serializer as receiver.
& f  T" s) C5 h' x! W*/- S; z, j- a7 |# A8 |0 @3 ~
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);' ]9 C+ j; Z, ^. ]3 v; m; ?
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*0 f; c* ^$ p. Y% U/ w  V
** Configure the McASP pins 2 ]3 A  I: Z% Y* J( [" \
** Input - Frame Sync, Clock and Serializer Rx9 B8 Y1 L2 k, ~
** Output - Serializer Tx is connected to the input of the codec
: v; p# f3 l' i% z& z$ a*/% F0 m$ ~! ]. y% l" Y$ d
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
1 q1 d! N# h8 b! _- M, r- W, IMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));( ^" A4 p3 }" Y9 {4 A/ q% S  M; ]
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
3 |5 g4 z# ~9 q& _8 s2 F| MCASP_PIN_ACLKX# `4 F4 [; k- j! G3 e0 S
| MCASP_PIN_AHCLKX
; M, A" U8 O; t/ @0 L| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */* ~8 O9 A6 K: G2 k* ?1 M% ~: _
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
) v( c7 J( L/ H$ ?| MCASP_TX_CLKFAIL ) }! p& ?# k: L: L9 q& b
| MCASP_TX_SYNCERROR% k" [& Z! N& N2 k
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
5 ~% @5 {8 Z+ a% A0 m/ \1 F7 E| MCASP_RX_CLKFAIL" X  y) i6 L: _' ^# a/ i
| MCASP_RX_SYNCERROR 7 Q, E1 N/ L9 i& [  [; s+ b
| MCASP_RX_OVERRUN);
1 F. i2 f+ Q& \( q4 a3 \}
static void I2SDataTxRxActivate(void)2 U3 x/ E! A! U$ X
{
# V: p3 _! O' ]: \( P9 x8 _/* Start the clocks */
1 Q& x( `; o8 E  o0 R2 zMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);8 N6 c( t* a2 A- S
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
. C2 M: d# [, U5 z0 o9 dEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
- o/ e7 X; L- i* [EDMA3_TRIG_MODE_EVENT);, w/ l: V* c+ V  S
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
0 j4 O4 f+ [) w  K4 {9 `8 Y9 v1 N3 rEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */( w8 E" x& M* P" W- F  O
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
( Z4 Y6 U7 V9 ?8 m0 wMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
0 Y0 I& c* r+ _while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */3 `4 s# Y3 }9 c9 \9 J) a
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
4 R: v9 O5 |. @' j0 \, H: c/ aMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);  s* |: M% T$ O1 W" t, N  Y
}
: t' z; N4 x$ Y* Q8 [; p
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
4 x( K1 t/ q6 K7 Z1 k& ?0 X8 d, t
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