MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,2 F1 ^& ^. @. x- m6 X# t
input mcasp_ahclkx,
0 }' N/ F% ]4 r/ Iinput mcasp_aclkx," S( b* q! i- ], g) i
input axr0,
  g* r, Z" x/ i
& M# j, H" d7 V- q2 w- }- B1 Soutput mcasp_afsr,& ~) Y1 h) _+ v6 `$ y
output mcasp_ahclkr,1 r) h3 l# A: L/ u" b  w& I
output mcasp_aclkr,
+ }2 b% z# \  ?output axr1,( W+ K( E. F1 f: j0 r3 _
assign mcasp_afsr = mcasp_afsx;& J6 c* `  [1 h1 {" B
assign mcasp_aclkr = mcasp_aclkx;1 h( G  k! t$ [2 q& o7 I. E7 @
assign mcasp_ahclkr = mcasp_ahclkx;
4 Q/ l# V% T( e( J0 yassign axr1 = axr0;

- ]3 d4 e( U, X
2 F8 F/ d  v7 j. E" k0 U
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
. D6 U* V9 b( B. V2 X
static void McASPI2SConfigure(void)' H6 C& ?7 ~% s2 j* e& T9 |& j6 f
{& |! @; x5 S; c% ~6 w* U; L9 Z
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
7 S1 P, c2 A5 |- w5 n, v1 i  h1 p' ZMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */% ]; f8 K- H* s( N/ S
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/ c5 u7 p# a; f$ ]5 u4 L+ WMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
2 s; P5 j4 w- r: K: E$ B+ kMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,+ }. d8 }, {# @2 w( u  P
MCASP_RX_MODE_DMA);6 o/ B7 ?3 f( c) _3 Z
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
5 Q4 X8 O+ f4 a: r; ~MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */) r6 [) I6 z, c, ?( j9 _
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
1 \( T- a$ F" Q; GMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
1 {$ d; K: M& i6 q5 t: V( ?McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, + g0 G1 a3 Y7 f; Z0 {9 x2 P  H
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
% R( O! {5 q% q( S- o3 tMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);$ J7 H" P# O/ w0 F% r/ i
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); ! E& D" i, x' z- S! [
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
& b2 h0 G: ]; B" L0x00, 0xFF);
/* configure the clock for transmitter */
$ b9 U0 c2 I+ V! q! WMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
* i4 [% e' s; W( [4 W+ I0 ]3 oMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
5 k+ B2 \* d' Z( nMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
4 q4 Z4 l/ v0 L* s& g0x00, 0xFF);" h7 W1 \% U6 m4 ~0 {
7 j. j2 j* u5 j. ?+ T
/* Enable synchronization of RX and TX sections */ 4 o" k) G( p3 r
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
* w+ t* W4 u2 x# z4 h1 G6 e! ?McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);$ J5 [- [1 i, B! c% d6 r. \
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*# k9 R/ Y1 u8 l1 m+ U/ W' @
** Set the serializers, Currently only one serializer is set as, f2 B7 W, y6 Y- Z0 ?9 q* ]( M
** transmitter and one serializer as receiver.
* p- Z2 M" L, t9 v- i*/
- ?% W5 e* W8 {6 j) {# M6 i7 g3 o8 dMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
% q& k8 i3 o$ l$ p, U3 p# }McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
! b. ]% \, L, g( W4 F5 A; S** Configure the McASP pins . {; R; T4 g& [
** Input - Frame Sync, Clock and Serializer Rx
- [- W: k5 m- D* Q** Output - Serializer Tx is connected to the input of the codec 6 P7 W% |0 q0 s( e* f" d( V
*/
! ]( E! N" w! c( ]McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);8 N' g: f; B8 d. V
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));8 ?) m4 g4 b* A3 v
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
5 I" s6 N* K) t# j" x| MCASP_PIN_ACLKX9 N9 q4 q1 f# G( d- U, O1 m* ?7 r
| MCASP_PIN_AHCLKX
, m7 x* P* d: ]+ \+ g| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
, Q* N5 R+ Y6 Y) l4 W* p$ yMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
5 f- f+ q* n# ]9 i' [+ A| MCASP_TX_CLKFAIL & v) P4 K3 H$ \9 }& s
| MCASP_TX_SYNCERROR! ?1 `' K0 Q+ W
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
" c( V) \% T1 G6 F) U6 k| MCASP_RX_CLKFAIL
, y; J3 Q8 ~# W  E& E0 ~* J2 r| MCASP_RX_SYNCERROR ( j2 u' }: j( ~  z
| MCASP_RX_OVERRUN);5 z, n& s, U: u3 J  M) }
}
static void I2SDataTxRxActivate(void)
! g, |' e* T" l1 a, w{
2 e- R, i1 h5 Q# c7 ~, ?/* Start the clocks */
$ S/ H2 F) H% a6 i- c- NMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
7 y) g, x) g; @# ]/ d, R; rMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
4 F8 z% E2 E9 I6 B3 p: m; FEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
# c. Y" S5 r/ q5 M" f9 kEDMA3_TRIG_MODE_EVENT);# A: U- a8 ^; B% u/ r. q: s8 ]
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, * ]! Q" X3 I( Y4 U- ^' _( G) v+ f
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
* T* \2 X: t6 G0 z5 L1 b; [. NMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);4 z/ p/ h$ `, O
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
: }/ Z$ }. D# K# J. q5 k2 k1 kwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */' _8 Q4 O1 R4 _  o- R$ h, a2 |2 m
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);& e) a4 C$ j; b: l! z
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
) l  @3 {% Z8 E2 q/ [9 Z6 T% ?}

/ _' e! D% x& H7 ]% F- \
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
% ^, r- p, J* D4 a% R
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