MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
( r: h* V/ L1 Winput mcasp_ahclkx,. [6 K& l% e) Q" ]
input mcasp_aclkx,) y' u* k  @% h2 i' y) h6 h
input axr0,+ u% D3 E5 {9 K: C7 G

$ U0 \* P$ U, s8 O" C+ G$ v8 toutput mcasp_afsr,5 f$ M% k. U0 D- h  K0 d4 {: s5 d
output mcasp_ahclkr,
! }( g% N# Q3 [4 ~output mcasp_aclkr,
' M: @. W. i5 Eoutput axr1,
& f  k* ~' k# B' q
assign mcasp_afsr = mcasp_afsx;( i* i6 A# \! H' i, }% S
assign mcasp_aclkr = mcasp_aclkx;
5 h5 B( P% [- [- F% @: {1 V  d' T) ~assign mcasp_ahclkr = mcasp_ahclkx;) F0 t; }' S( n& C; M! T
assign axr1 = axr0;

0 a3 b! |( S+ h4 X9 s1 D& q4 ]1 E+ x- `+ b
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

9 m, F) ?5 e. i0 m% d+ Y! D
static void McASPI2SConfigure(void)8 B! n* C0 s5 j3 a9 [% `
{
+ Z& V: C# g( j+ d: NMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
5 ?! J4 A4 W% \" M: y- D7 Y  wMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
: Y. i0 n- o, R: G  M5 Z- vMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);0 H* e9 M' b. z4 t" I( r- V
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
% V- e8 p: U5 T! @McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,# ]/ f) x3 h: A# m7 i1 Q
MCASP_RX_MODE_DMA);: u, v# W4 V3 ^# @3 ?% S9 i* O" j
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,5 S! W2 Y9 C" y! \  S# l/ i% g5 ^$ k6 a
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */. C: k, H, M, q9 X% ^
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ( Q3 C, n4 C4 h% E
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);  c8 D# \  _. K& Z5 S
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
" ^* d1 l- v/ M1 }4 c  }' |MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
; l; x7 C8 K$ L4 a6 f  lMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
% m: x3 k  f4 RMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); . V. G. i9 ~0 R) t; Y1 X, O+ V
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
2 n* \8 h' l) ~) p0x00, 0xFF);
/* configure the clock for transmitter */
$ D  G0 U9 @0 l" }McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
# H1 `$ t6 H; [& j& T2 z* xMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
8 k0 |0 W8 G3 K2 j; g4 W# YMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,  l% t! A/ s, ]  N
0x00, 0xFF);- o* [/ s  s  J, F
8 [! e. Z& \4 Y7 d6 Y3 e0 f$ a/ X
/* Enable synchronization of RX and TX sections */
  U* s$ G/ v4 E! lMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */' y3 ?2 ~: e( u) v
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
; i9 k9 Q- ?0 _) U. K2 N5 iMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
& ]. \' |9 G1 E* Z** Set the serializers, Currently only one serializer is set as$ {+ E3 ?/ f% t0 b% v9 b
** transmitter and one serializer as receiver.
4 y; M: u" P% E  G*/& i5 ~; C" H5 ^7 J1 b
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
' j, E" s3 N) CMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*7 g: C! w' N7 v! F7 Y0 B
** Configure the McASP pins
) ~* r( L8 P4 V** Input - Frame Sync, Clock and Serializer Rx* l3 A7 B0 B/ c# l) S" A- \$ L
** Output - Serializer Tx is connected to the input of the codec
/ u" _6 L. o* G* j1 Z: f! \*/* n2 p" B4 Q2 d) U/ j
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
& P0 h" n# {) E# s9 vMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));0 C% N5 F: H/ \2 R$ U1 [! e' J- T
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX* D- C/ \+ t9 x: H- v
| MCASP_PIN_ACLKX! T2 l! ], q. O. `. \/ H
| MCASP_PIN_AHCLKX( Q3 i$ L" u* R  H4 @7 f
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */, l) e* S9 K9 ]0 U! Z
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 4 u; |4 W# @) s% ~1 D" q' m
| MCASP_TX_CLKFAIL
  T; S* @' y) v5 H| MCASP_TX_SYNCERROR$ p# v% |+ M, k- a( `& k& a
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
$ W0 x% L  b# b. \5 c8 l2 F| MCASP_RX_CLKFAIL0 Q+ V! |: N6 [7 u) a0 ?
| MCASP_RX_SYNCERROR
! x" |( R6 q# E| MCASP_RX_OVERRUN);
4 T* P4 f) ~- I5 Q$ s7 h6 a}
static void I2SDataTxRxActivate(void)& ?4 ]  Z* E3 |' J; e% M
{
3 L$ F# c8 A" |5 m0 \/* Start the clocks */
% ]$ V/ K0 \( Q2 EMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);6 v. h& d4 M2 o: `2 h
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */$ m1 {4 f  [: T: I8 s
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,7 Z. s# g1 d* Y
EDMA3_TRIG_MODE_EVENT);
; W, |8 f7 m* q4 e+ B+ yEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, # \4 x9 C& K  p
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
- P, Q- e4 w+ ]) S  y* a. {McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
; ^) @6 ^+ }/ _7 UMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */3 R) ]$ x& ~3 U
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
7 p3 q, H7 Z3 J4 j5 ?+ _McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
* l3 B' P6 S! x0 D" XMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
  i# @& v9 i* o" \}

- J# k( \9 r6 {! l/ B% m. k
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
/ I( j8 s2 J# _( W; X  U
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