MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,9 e2 k+ ?' Y5 |$ l, n- O8 n0 m5 o
input mcasp_ahclkx,1 N3 E2 g  K) U. a  x- g
input mcasp_aclkx,
( t" [3 i6 k; f1 Tinput axr0,. ]& i7 s" B  P2 x

2 a+ q" ~# S0 a; c8 loutput mcasp_afsr,
4 Y1 j; x% n+ [% Noutput mcasp_ahclkr,
, x2 g% q" T% e8 v3 X# \' Ioutput mcasp_aclkr,
. I! s/ W+ J( koutput axr1,
7 {; {7 b8 ~% z) L1 @
assign mcasp_afsr = mcasp_afsx;
2 `5 f) k$ q" o. n, lassign mcasp_aclkr = mcasp_aclkx;
7 e3 @  r( k6 {  [assign mcasp_ahclkr = mcasp_ahclkx;
; B: B& X6 a% O0 D: k) Wassign axr1 = axr0;

. n& c# p# ]# C2 |9 ]' q5 F* w1 a/ E- k$ C; R$ m# y
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

( e, e: W3 d* G, ^$ ~, X( f) \6 Y
static void McASPI2SConfigure(void)! l0 N* k8 V' Z% o9 a1 E
{- T" L+ o$ Z% v' Y: {* g
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
& Y$ N2 K' w$ S# S+ h. M/ VMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */- u0 W1 F  H+ w, R' ^$ t
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
5 _7 t7 O6 x4 D# E; W) G' AMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
" f! f- ^) Q* P0 Y9 c0 G5 A3 KMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
; K8 S) R; L: |8 v0 SMCASP_RX_MODE_DMA);8 k) l, @& S0 j: F2 ?
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,$ U* c) {/ v: A, W, [9 @9 k
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */4 {- k" o, n& E2 A* Z* Z
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
7 J, E- ~9 ?" K' Z1 }MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);1 Z8 E( ]" \$ `, C$ S" g" I/ ^
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
* M- }! [" F4 ^4 e( LMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */6 _4 b7 h+ t4 `( e7 q
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
& e4 V4 k* x$ c" s% LMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
8 g9 V0 L3 G1 L5 f9 x( JMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
; [8 F- U$ j8 R2 f0x00, 0xFF);
/* configure the clock for transmitter */
8 X3 Y  }) ?. ]& Q: NMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
: ]; C: f# t$ k+ }: rMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
( U: N" P' w9 ~8 l+ DMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
8 W1 s, V5 V% z7 b6 c( e0x00, 0xFF);1 X. j. b3 ]( C
8 q, A! u' C% o- T# o- \) m
/* Enable synchronization of RX and TX sections */
( }0 y0 A2 Z- y) \7 oMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
6 A8 s0 N- A  J! u# }5 S! AMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
- |% `8 G! I+ L6 iMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
9 F9 d" i" p  ]1 m# @3 C* u8 B' @** Set the serializers, Currently only one serializer is set as3 d& S- a0 v( O  a7 r
** transmitter and one serializer as receiver.
8 U5 m5 D" e1 D! w1 w& n$ m$ ^*/0 \1 A4 R" f, G7 `8 C5 @
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);8 r( d6 b* g5 ^' d5 a; O$ A7 |
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
% g$ M! r2 x- l4 k7 X+ s6 \+ x** Configure the McASP pins 4 Y: a) V* ^! G' l, ]
** Input - Frame Sync, Clock and Serializer Rx
) D& @) h: W* M  d0 l  ~** Output - Serializer Tx is connected to the input of the codec
: o2 T! j' q6 x/ ]5 q*/
5 J- P- o5 L! J, x5 Y# |; F' PMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
6 ]% D" @6 g9 r1 n' ~McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));1 r9 K" e- z4 b* @* H6 D" {
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
+ Y; b* p3 R: s7 N! ^( h| MCASP_PIN_ACLKX
9 @3 }6 F% y/ g2 S| MCASP_PIN_AHCLKX9 r6 ]+ V" [% G7 `# e8 e& h6 C7 I
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
! J7 ~8 }0 I. f* i* `( a/ q8 q, p& c2 aMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 1 G, U0 j' f! @8 w2 s- L
| MCASP_TX_CLKFAIL   U& H' e* x% s  R; Z0 d
| MCASP_TX_SYNCERROR
' `, ~5 {1 g4 Q& V5 W6 `| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
' }5 r/ m1 Y9 E% q2 `" h| MCASP_RX_CLKFAIL7 g* g* P2 D- Q) J
| MCASP_RX_SYNCERROR ) o) {; p+ s; H5 l4 P
| MCASP_RX_OVERRUN);+ |7 M: Z+ h2 g/ j: I7 D2 h( z1 Y
}
static void I2SDataTxRxActivate(void)" K6 b) r7 N2 R0 F
{7 }1 i" O; a7 G
/* Start the clocks */" o- w8 ?7 n9 |( h
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);+ S0 ]$ H) a9 o) R7 s4 i6 t: \$ t
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
9 I& d( Q- t# y  n7 p0 y6 y- H! e+ yEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
+ m, L. @  T1 I3 `EDMA3_TRIG_MODE_EVENT);
1 h& J4 d* D" \, \$ l) T" j4 _EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, % X/ A# N3 x6 i. w* [( q
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
1 z( I, I+ a# k) \0 t" OMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);! g4 d: \, Z; n+ d
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
' \- v. t: F/ C* \! B8 H# S7 lwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
% L$ L& o. s- Q- }McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
" X! W; [2 I1 d1 d9 n0 f& H! zMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);; D7 |9 i* K/ v/ s
}
& t. L$ d1 O9 P3 ]9 S- e" `
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
6 }- p4 P0 b! j7 _5 ]
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