MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
" ?1 U/ D6 s! Y6 l1 {input mcasp_ahclkx,8 _6 o0 p, h; T6 x: K
input mcasp_aclkx,
; J) {, d; p2 O4 D# Z6 K% L. n! [input axr0,/ @( w3 Y0 M7 t2 s6 }9 c( b& L
# Q" s) g9 g. }$ T; b* v2 S
output mcasp_afsr,4 M; V8 c0 E& ~) Q  \# f0 K
output mcasp_ahclkr,: w9 t6 ^' K8 C
output mcasp_aclkr,9 f1 k3 j( V$ V6 z# h& F! X; Y1 T! v0 W
output axr1,
  M% N2 a6 W1 s4 T; [( ~& s% ^& C
assign mcasp_afsr = mcasp_afsx;* U, I6 y' H4 \, g/ ?
assign mcasp_aclkr = mcasp_aclkx;  J8 k- j( i, Y- I  L5 q6 R
assign mcasp_ahclkr = mcasp_ahclkx;/ l; f, C6 m- J/ `: _+ K
assign axr1 = axr0;
& v! n& d8 k/ z% G3 `
- |6 o( u: c6 c; |3 y  [
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
* O% W1 m" C% ?: C
static void McASPI2SConfigure(void)
6 h4 Y; i/ F& [) e) V8 C/ J" I6 O{% d7 S9 Y9 p9 s6 {0 r6 V8 [% J* a( a
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
9 _7 A3 {. ], N% u& g# ~; e7 g1 S# rMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
$ k; a/ a$ w7 r4 S) k. Y. j& CMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);3 r/ |/ |' A9 i: k) ]  z: c: K* p
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */$ P1 ?; m; X% ~
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,# J! O; E! U0 V. u$ g
MCASP_RX_MODE_DMA);
5 S# T! {+ q/ I  @# k: a! K# M0 iMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,/ `# D: L. x& n1 ?  c# ^5 r. x
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */5 b# x7 O. h6 G, o- X# t
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
- T+ R# K; n" {) KMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);1 r3 s/ f- E# o9 b5 R; V- m
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
% w% j0 ^( m2 u$ ?; Z' r. DMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
; o$ H0 f6 ]* d9 J: xMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
9 H7 c9 {- p% E0 r3 h/ B- I7 oMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
' K8 s1 B! e6 H  K9 rMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,( _( q8 U( ?: n
0x00, 0xFF);
/* configure the clock for transmitter */3 O7 F; c- }7 w3 Y2 C' `( }
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
+ n5 Z1 I2 A+ x" c3 Z( ~McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
4 b6 \" e0 k" l. I! P4 m- W, cMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32," l4 _/ B# Y( ^! Q  L
0x00, 0xFF);
/ @& x' @# o( |' Z8 ~/ q" Z& q; K1 E7 M. X! q
/* Enable synchronization of RX and TX sections */
& p) p' C3 N" q# LMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
, e9 U% J( X* `- {4 GMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
6 L4 {: |) e6 |& g5 e" z' nMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
( b  V7 _% Q6 a. ?7 f$ y5 @# n** Set the serializers, Currently only one serializer is set as
4 f* S* J7 s! U( g/ {! B( G$ ~** transmitter and one serializer as receiver.5 a2 s. ~8 |- n5 a
*/
# M" \" ~, U; \7 `* @: K5 KMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);- b$ C3 a, m- M4 z6 R1 O
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
9 g. `! S' t) m  z, F4 M** Configure the McASP pins
, h' {7 ?5 Z+ ~0 P( W7 ]** Input - Frame Sync, Clock and Serializer Rx
8 [+ D7 _& ~) s7 u! h) W** Output - Serializer Tx is connected to the input of the codec
$ }: F7 D+ B, a0 b5 ^*/
6 p8 u/ O- Z0 ]; {, |) cMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);6 m9 U6 `( `$ @  R5 B2 ?# D2 _
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));4 ^. y# d( c8 Z" ]2 c0 [( z7 _
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX4 i/ m2 S- R% e- N3 A
| MCASP_PIN_ACLKX
- j' q! X7 s! U1 a4 Z5 g1 V| MCASP_PIN_AHCLKX* K) c$ z2 ^+ I# @: C; o6 I
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
, f# X9 q% d# T5 _# o4 N. q. v  |McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
! j6 v6 A6 _+ U| MCASP_TX_CLKFAIL ! m2 l" Y) t* q& N5 W
| MCASP_TX_SYNCERROR0 ^' g! k( L$ u
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
9 L7 R. [  N' t! k| MCASP_RX_CLKFAIL6 N2 Z$ i: m1 c% z' U$ M1 o
| MCASP_RX_SYNCERROR ' U$ ?9 ]: E7 p3 @, B/ Z
| MCASP_RX_OVERRUN);* ]0 v8 W; o9 l: [( s
}
static void I2SDataTxRxActivate(void); \# k, d$ S* V0 b
{9 T! s+ F" C4 {+ e1 @
/* Start the clocks */9 p! V' r9 T7 Y6 C
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);) s6 t" b$ O) M# a
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
1 ^" u2 h3 k; G* n8 l9 E" nEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,5 B8 c+ ^8 n5 A& q! a% h# j. p
EDMA3_TRIG_MODE_EVENT);- Q6 F- I& G! |. P! T$ _/ z
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, 7 W: i* g: R% Q' W, o5 Q2 E
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */0 f/ n$ h2 k% ?9 _. \/ m
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);, ?0 N$ h7 f1 I
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
( J" z6 f1 e7 j" Y2 O/ n" Gwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */1 }1 j" t+ ~# w/ l0 I( F2 h5 Q
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
& f: x" S0 m. _* F9 D1 nMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);" E6 ]1 Z# m3 M: o3 \* g
}
" n9 ]0 M7 g0 k3 P1 \/ n9 d+ Q
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
8 P/ G  m$ f; {8 a0 V' M
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