MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,/ R2 X& Y* _; m2 P" ]- C+ U) `: C
input mcasp_ahclkx,
2 [8 H( u& `& V' h+ Vinput mcasp_aclkx,
8 w6 c% w# G( t0 c  Q7 R4 _input axr0,  [* w  L( e" y
" w( u. v4 |1 Y/ I" F- G5 |
output mcasp_afsr,
+ ^- C6 q5 S) v5 Toutput mcasp_ahclkr,% g/ B" M* n. @# Q1 ^( f; j
output mcasp_aclkr,& g: B! Q  _5 x
output axr1,( [* U. G* W" M+ c- W6 \3 ], |9 b. i
assign mcasp_afsr = mcasp_afsx;" z3 M/ n# a$ t
assign mcasp_aclkr = mcasp_aclkx;
; {$ g. _# W. F0 y$ w* passign mcasp_ahclkr = mcasp_ahclkx;
3 Y) Z2 V  ^* Z% W! X) @) b: Cassign axr1 = axr0;
  u1 b" f- ~) D, K

  S  l; d) \$ ~! M
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

  O- H' o( h) u  J2 U
static void McASPI2SConfigure(void)
  N, w; K( Y( |, E, h* I{& A3 _: m; y- q$ g' B7 I
McASPRxReset(SOC_MCASP_0_CTRL_REGS);1 r& O9 n: a% ]5 o0 W2 Z" g
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
' {6 n% k& y, h/ J3 UMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
1 p8 G2 a/ E0 xMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
. A% X% }3 H5 v) v+ k4 ?3 v8 o9 Q7 _McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
  ?. }4 A- t$ G+ j+ \# e9 PMCASP_RX_MODE_DMA);
' q  O% i& e; Q7 }* Z5 JMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,, y4 W- v& W( @: Y3 C( b; M9 z2 V; [' C
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */& A6 z; c4 y3 L( Q, S1 C
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
+ }" Y; u, @+ Y1 ]MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
. \/ X  a0 b% ?9 o9 p! W! V  yMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ) Z$ s- ?" t. l2 W0 j  V2 s
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver *// k( j# E1 U3 U5 q5 b5 {  T
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);5 e& f6 c5 w! W& T$ q8 p
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
/ ?/ ?! a/ l$ e# x3 e: b% pMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,9 B2 u# V3 L  g. M4 N
0x00, 0xFF);
/* configure the clock for transmitter */
" }1 n# C5 J1 d2 Z7 `8 q  P" jMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);' K' ]0 J! U' z  K9 a! F
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
' P6 R9 a- a/ I  |7 hMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,3 F2 B/ m" `4 Z7 G' o
0x00, 0xFF);& E2 t' _: C- o

7 t5 g, y9 }4 b/ U, n. L/* Enable synchronization of RX and TX sections */ ( M' J! z7 l; K- V; V# a
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
. x) o9 I. N0 H/ }( GMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
# E& S7 M3 F% dMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*: v) O% v+ }% d* S5 `1 L) [
** Set the serializers, Currently only one serializer is set as
! K  f+ o6 z, p  }** transmitter and one serializer as receiver.
  C4 }" |2 j7 C% Y" e. K*/# \. G4 L1 Z. Q
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);+ N# J3 V3 t' n* N$ c. {# c+ w, E
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
/ H1 a, w/ C; H% o: Y** Configure the McASP pins
; Q; B5 v$ f% R' K' T** Input - Frame Sync, Clock and Serializer Rx# G8 N) H6 P, \( Z% }- P& O  n$ H9 E
** Output - Serializer Tx is connected to the input of the codec
8 p3 k. ^# ?; o0 i8 r, A5 Q- ^1 p*/; Z& K# z3 x. ], T* E1 q9 A
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);% q; |# H7 T$ m- h# V
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
# W; z$ J, |4 EMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX& V: t7 z# c  J+ A6 ~. f
| MCASP_PIN_ACLKX
( t: I8 |# x7 ]- O5 j0 N| MCASP_PIN_AHCLKX
& V3 b2 {6 |" p1 f, i6 z| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */  p1 V- J# @' E* {0 C! f* p
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
+ p# y; p+ k# T4 N% S/ |3 r) N3 T| MCASP_TX_CLKFAIL
6 E0 \9 L2 w+ C9 d4 a9 [| MCASP_TX_SYNCERROR
" Y& X/ [/ Q0 U% A* H- n| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
) A( d4 M' `9 W" y3 T3 v; I| MCASP_RX_CLKFAIL
" W$ e# g/ M% W" `1 k/ t- S% g% a) p| MCASP_RX_SYNCERROR 8 v; t( V: Q8 v; B) A, Z! T
| MCASP_RX_OVERRUN);
" _( |. {2 }, Y5 N5 [' }0 L3 n}
static void I2SDataTxRxActivate(void)
; v) `$ {! D% C+ W, L6 h{
5 V1 \& u  ~1 [5 ]+ a9 Z9 E/* Start the clocks */* F, \7 c& a: ?9 `& G
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
; s9 N0 ]6 k& m0 cMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
( t9 Q5 P2 v; q2 Y/ ]3 o" u3 C9 C- AEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,1 w& d: E5 U9 x- s7 y/ b: ~
EDMA3_TRIG_MODE_EVENT);5 V' _# W7 I$ r4 s! M
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, # F4 @% t, x* L4 X
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
9 `* k$ v, d! R2 L3 qMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
" h8 ?7 t4 f  f. hMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
3 S+ M! u2 Y7 C+ K. }4 Swhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */" ^: o2 O# ?0 {# Q5 D: O
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
; ]1 L: I' e& Q/ TMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
% n0 I; z8 c# U+ S' ^# E}

; O2 x- a! O( Z. I  ~- [
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

5 w" o+ Y" Z3 }: p, H: f7 ]
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