MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
0 t' k" B/ Q7 o4 Q3 G" jinput mcasp_ahclkx,
7 L! z7 C, C1 i7 minput mcasp_aclkx,
/ b( M" I7 B. |3 G" a! i4 {3 Xinput axr0,/ z7 E( P, }; l  x' Q. T9 E/ \1 `) \

! |! I- D4 Q$ I8 o' moutput mcasp_afsr,
9 g0 J2 O5 D, F3 W, s$ R) D. V' ooutput mcasp_ahclkr,9 z8 L5 G4 L) [: _' z- U
output mcasp_aclkr,) q0 b# y# r% }. v8 _' e; l
output axr1,# ~  j# h  ~* b. \1 ]
assign mcasp_afsr = mcasp_afsx;7 E3 b7 w0 |3 b6 i' [) O
assign mcasp_aclkr = mcasp_aclkx;
  h. i+ R' u% A9 z$ {( cassign mcasp_ahclkr = mcasp_ahclkx;0 k. Q1 |4 P- V0 p1 L. q, R7 ~
assign axr1 = axr0;

3 c' {! b4 G  k1 C( u1 L8 n; M/ n  l" Q. [- u  @8 d
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
$ i- N$ ?4 U4 N* a: \
static void McASPI2SConfigure(void)
; \* e3 S* G5 M2 G) h{: U4 {6 Y$ p% u1 V' t6 o
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
" r- U8 Q( ~) A! ?8 {$ [McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */; h4 [# j/ l. [- T& S* s
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
4 ^9 a/ M% i( o( c1 H8 w' d# mMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */3 ~0 I. l8 o+ ]' |
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,* ]! W/ ]  Q' `6 R
MCASP_RX_MODE_DMA);
2 w0 ?' k  u, R! {McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,8 L- c: p- ?( q2 t! Q" q
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */6 Q  a6 e) Q0 _; Q8 I. n
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, , _8 c8 d- N' `" \4 O
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);; L) ?; B2 T! s% W* j9 ~3 L
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, / f* |, B, s0 k# u( t
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
( M, u5 M$ ^( ?' A2 u" BMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);+ X$ L0 {& A! e- F$ |
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 0 J  i& h& R# B" |
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
9 g, r9 E4 t( A6 s, |2 O  |0x00, 0xFF);
/* configure the clock for transmitter */
( `5 F1 Z: [9 C) o- QMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);6 ]. r, E, |& f% w) N# R, |! S& {) F) U
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
( n1 Y1 E* ^; W- z& s7 \McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,0 w- {6 _0 o- A) |3 c
0x00, 0xFF);$ W4 Z( U) H: D9 {" G5 S) y4 E
- Q+ y' E4 r6 X
/* Enable synchronization of RX and TX sections */ $ k, \% |) a- _$ `2 v( V/ _/ L& m
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */) F0 h% l5 T+ Q% g
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
) ~$ X2 D% Z# C' @9 SMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
) _# T- n, h3 H** Set the serializers, Currently only one serializer is set as
% P; R- r6 M8 `3 Q7 t  }4 E** transmitter and one serializer as receiver.1 z# k6 p/ e* k( O
*/
: y. S4 H2 d" m9 }4 P% iMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);% X( O( t3 F. E% N
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
" p% }9 Q; k8 p1 C** Configure the McASP pins
% Y& E5 L1 r! M** Input - Frame Sync, Clock and Serializer Rx! s4 r/ `( ?% m
** Output - Serializer Tx is connected to the input of the codec 7 r1 Y8 z2 I0 C* N, f& m
*/9 G9 B8 `0 P/ ?* H; v
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
/ t3 ^  ]& w! J% jMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));! |2 m& n2 J# K! U) C
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX3 G/ z% m/ P- A. d3 m' \8 M" a
| MCASP_PIN_ACLKX* o. d4 i! j; \
| MCASP_PIN_AHCLKX
  X: o2 V) L. P4 C| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
. F( Q0 g/ ^$ hMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR   e3 y3 b" i4 p9 H. Q( E5 o( w
| MCASP_TX_CLKFAIL
8 b0 A( z' {0 C* R% g| MCASP_TX_SYNCERROR  w/ @* ?5 f+ h) B* i* n& f, |" `
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 8 g& f0 y) `0 y( y
| MCASP_RX_CLKFAIL
/ C! |$ m3 I+ Y4 B3 p- o| MCASP_RX_SYNCERROR
1 _5 A6 p3 Z& t8 b! e| MCASP_RX_OVERRUN);. o6 k% i: ]# @& w! N+ n. s" v
}
static void I2SDataTxRxActivate(void)
! |0 Z, ]6 ^- w{
9 T5 `9 Y) Y$ A, z6 s  U/* Start the clocks */) L. w6 C& x5 d3 f9 }1 k
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);1 R" e  c% X7 M* l
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
+ ~8 B$ Z" F& D) `EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
; a2 ~4 R6 i7 S$ G$ i2 u: ^2 SEDMA3_TRIG_MODE_EVENT);/ j2 L2 n$ m8 f! P. T9 r
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
) k, `1 F% K& GEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
( i# |: w% r% z3 T7 M8 fMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
1 W# J8 y7 J/ x  A( o; _* cMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */: m4 [: M$ F5 G8 C" c
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
% z7 x, ], J* H2 E: y: Z3 cMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);0 i; L9 ~7 G( A9 L3 k. W
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
! B+ F* J2 Z+ ~5 j; w8 \}

6 M9 L" I1 @0 q! E( I+ o; P
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
% i+ g5 a- d  X8 ?8 k
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