MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
3 w% ]$ [3 {( N. i/ i: \input mcasp_ahclkx,
% `4 b6 w$ b  P7 iinput mcasp_aclkx,
- v$ e4 H- I% jinput axr0,
8 o% |9 {( C  p9 g: M) m$ s" C# k( r, ~% A. \5 ]6 A  N7 P1 }, i
output mcasp_afsr,# f: u8 \- p8 `: W# n
output mcasp_ahclkr,
- h1 r" `/ [; K% c+ eoutput mcasp_aclkr,
4 z5 w1 _  G( Soutput axr1,5 J& O4 X6 q3 T; ~/ m
assign mcasp_afsr = mcasp_afsx;
" v, S# \4 N8 k- h. E4 Yassign mcasp_aclkr = mcasp_aclkx;
- c! A; ?$ o! q+ D  @* ]9 t; B- Qassign mcasp_ahclkr = mcasp_ahclkx;3 J  A6 ~$ @9 E4 Y
assign axr1 = axr0;
  ?* O. a  P6 Y" Z* K8 K
% [! H* g0 q. F0 E
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

& F" v' c2 j2 P" j1 A) X
static void McASPI2SConfigure(void)
* j& S6 f) f$ ~$ q; v. V( S% |0 k{
: s& h# _  B6 P8 l/ KMcASPRxReset(SOC_MCASP_0_CTRL_REGS);. T  b5 u+ R8 p+ x; E
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */* i7 m/ w/ a0 b: j& @: J' z6 o5 Y
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
! v2 a" C3 k  _/ m) e2 ?: V# |. LMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
1 {5 c, }& j8 SMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
* t. B; r) _' G" g! D3 W/ ?MCASP_RX_MODE_DMA);
0 o% M. T* ^$ ZMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,4 P  G9 ]2 L( o4 Y6 L* X4 x
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
5 _5 C4 A4 \2 f6 F- {: p( K1 oMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
# D& O. B; Y3 Z! o) a" tMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
/ J" M: X9 L- E8 A& ^+ oMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, : b* o! \/ P; @
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
2 l' W3 F# W8 w; A' K( t$ G: KMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
: G+ u/ P6 k% q5 i5 yMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
( _* M* ]! E! G; f. OMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
& d/ ~1 P0 G4 O* j! m0x00, 0xFF);
/* configure the clock for transmitter */
/ F# ~! y: `3 B( Y+ z  `  o& |McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
: I# |, n. f9 dMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
$ ?  t- c, w) ?McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
- _4 }- Z& U1 P. K/ o4 Y, c1 [0x00, 0xFF);  j5 w9 e- U9 }2 P% f5 Y
+ J3 k& d5 k- O9 T3 y! [# G0 I# ~
/* Enable synchronization of RX and TX sections */ $ _) H; G5 O3 y' T# {
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */, k! p; b( z- ]* F3 ~1 d" x
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);* s9 k$ S, O9 k: D( Y4 z! k$ G) V+ @
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
9 Z0 N! V/ G6 i# {" A. _$ Y4 ~** Set the serializers, Currently only one serializer is set as
: l# ?/ f1 e/ U** transmitter and one serializer as receiver./ x7 o& u  Q) n0 l
*/
& I( \/ _' \3 Q1 K: WMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
( A2 N% U' }3 R3 c, kMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*  l0 `7 U' j2 |4 T# W- e' o0 f
** Configure the McASP pins ) l0 S% m* i. Y% `9 |
** Input - Frame Sync, Clock and Serializer Rx
2 l8 h, D: F: b+ v6 R** Output - Serializer Tx is connected to the input of the codec . |7 z6 J3 |. y, ~3 r
*/5 H4 e3 |) @- ]1 D# s4 e
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);& f4 X# A: E1 C6 q& m
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));8 i3 _& E. z" S
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX: S1 I- ~# V- F1 x# S
| MCASP_PIN_ACLKX
; q/ G/ X* _/ _% [| MCASP_PIN_AHCLKX
5 t4 d! a4 D. Y| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */+ b3 v- {+ J) H7 E# n# w  y; o/ p
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
6 a) h6 I5 }$ ]: I| MCASP_TX_CLKFAIL
) ^2 B; }# X2 L| MCASP_TX_SYNCERROR
4 A& Q$ f0 O$ j% b) {) i| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
( k) t2 V. ^2 H3 o0 J# M& g# f| MCASP_RX_CLKFAIL7 T% f. D7 T% u; I
| MCASP_RX_SYNCERROR
" d! T' B3 I1 \8 p, Q| MCASP_RX_OVERRUN);1 `, G) X$ q$ f0 u7 V# x
}
static void I2SDataTxRxActivate(void)6 j! p$ a+ P1 P% ]/ s. j* M4 t  v6 G
{7 k0 S3 Y1 U8 i3 h; r% x
/* Start the clocks */+ c6 w. Y$ }; o& C) V. |) n
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
2 ]1 L1 u( ~, R8 F% P( mMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
4 L- M- b2 g0 }. e! VEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,; c! t; W" @; n; E8 w5 A
EDMA3_TRIG_MODE_EVENT);9 r6 t0 I4 k/ x: p  s; m
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ( k+ h% o  O* D! @- L
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */$ n) k: f/ M2 B4 d1 l9 @6 h
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);' @  `3 [$ K4 T8 |9 a& c
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */9 |0 @  N& B/ e
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */9 b7 |9 w6 d/ c) e" U/ V
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
# [& |3 p: @7 W& QMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);  r% v* L3 a2 a0 j6 g8 l# V
}
2 i  x8 R' z! ?1 r
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
6 q0 l: n' V& a( r! ?1 S
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