MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
' P2 i$ L) V7 ~9 {* j* J% Y' Vinput mcasp_ahclkx,. l9 q( C" u6 n; s( a$ t
input mcasp_aclkx,
0 j) Z, `' f% F( c8 w2 a; I2 ^/ kinput axr0,2 o8 [1 f+ F( e# W) I2 c) D3 K5 X, d4 z
( S% O6 u( G: b3 s) A* A- w
output mcasp_afsr,
! N) P" s2 S, C+ N$ X% Z+ ooutput mcasp_ahclkr,
  T! o+ d/ U/ _0 [: z: ]/ t, o: Coutput mcasp_aclkr," Y( _! I" D  Y1 u: Y) p$ j
output axr1,
. p' E9 S6 K; y
assign mcasp_afsr = mcasp_afsx;
& [* B$ i( O% G6 J8 B" massign mcasp_aclkr = mcasp_aclkx;
2 b3 L7 G: P; j1 E5 U, Nassign mcasp_ahclkr = mcasp_ahclkx;
, W( w8 T4 S* u, a9 p' y+ jassign axr1 = axr0;

" W5 k* s# K# p( b  i! b6 q9 k6 M; T6 [; g1 ]) f
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

. z# w; E1 v5 U
static void McASPI2SConfigure(void)$ |. }% E9 z1 j+ w
{) k# T" k+ A, O1 Q, Y; m
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
) l( {* M. r0 c, WMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
6 F7 j5 A4 s' O9 Z( L1 i8 ]6 ]McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);2 p' M+ }: y1 e) g
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
" ^. y. }4 ?1 lMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
! R- P9 N- C: f( P' L2 tMCASP_RX_MODE_DMA);7 V* p# J5 n5 t/ j; f
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,$ V' x. ]1 D" f7 M/ G6 U% @1 `
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */3 g# s& d0 X/ e' o' _
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, " `4 ~! _7 r$ c1 I/ O
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);: j' b; y  K/ F; O* g: p
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, # u! i3 V5 ?0 W; K; f' j. J
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */  Z) p! [. A( A# n7 o  R
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
" V3 D6 B" V+ d# {; [+ r) D/ \" uMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); : A( Q4 u" u: z# Y9 a2 X
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
: h8 I" q4 e' f9 x( ^# L0x00, 0xFF);
/* configure the clock for transmitter */
1 d: J, T5 T1 z7 _1 d) O  a; W( YMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);! ~6 }* ~. {) g3 |8 B8 o  t+ z
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); , n& z" x9 f; ]8 j/ W% X- U
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
9 _/ {' _4 T; I7 @0x00, 0xFF);& k( P# H, Z) v4 j- U8 N5 p
: g3 [/ O+ l! |7 B+ v) Q
/* Enable synchronization of RX and TX sections */ # `4 {3 `' L1 a1 ^3 j- J; T% ^
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */7 j; t, J0 ]" ^8 d1 m. ?
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);1 c' L. W. f/ ^' W( {2 C
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
" _2 K  i  `6 I, O+ U$ ?8 K  q5 h% s** Set the serializers, Currently only one serializer is set as
; f: W2 b" s! ]$ G* j' r** transmitter and one serializer as receiver.; q- W: r6 U: H
*/- y2 \2 _! @7 C& z/ D
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);" u7 f- S* V' z7 E1 ?: E
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*- n  G$ ~% _# M! F+ _: M. P
** Configure the McASP pins $ {& j) E0 v6 G
** Input - Frame Sync, Clock and Serializer Rx* W! S/ Y! V/ Q7 D9 P3 O7 ]1 X  g$ K# o
** Output - Serializer Tx is connected to the input of the codec & b+ R, G6 p2 p. x& _% O
*/
9 V) t( z1 i+ M5 F4 L$ C7 i: ]* @/ C/ XMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);& ~7 Y( A: Z; [& c5 j) O, Y( s% `
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));1 G, z6 ?& F/ ]1 y' O
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
2 p0 F: q$ M4 I. p| MCASP_PIN_ACLKX
& a* X; v: B6 p1 d( ?6 [- L| MCASP_PIN_AHCLKX
0 r/ q! z9 V( g4 J| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */' o$ M8 o3 O& _* A+ c
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
9 t+ }& t% Q' `2 E$ K) u| MCASP_TX_CLKFAIL
" O: S. `# v4 ?| MCASP_TX_SYNCERROR
0 @, D; n& v5 A, t| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR * d# J1 x4 h) E9 T* M6 u9 _/ `
| MCASP_RX_CLKFAIL
% ~& |/ B" b/ v4 I| MCASP_RX_SYNCERROR
4 X+ Q# ]% c' N| MCASP_RX_OVERRUN);
  d& Z/ M# r, G$ g. C9 U  t}
static void I2SDataTxRxActivate(void)
# C& b$ c7 Y, l{2 t& k) g% K; C
/* Start the clocks */
4 j2 |+ h) L, s( AMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
/ O. R& j. g( a# O1 T% RMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */3 K' U4 b) |) D' V
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,+ H+ p1 z- K" C# m; E0 }
EDMA3_TRIG_MODE_EVENT);
+ |. ]' Z/ {1 x0 Y2 B3 BEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
: s% N: z; L$ OEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */, Z; c+ r; x( D, V2 j
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
) Q1 y5 x! G% c- _2 x/ f; _McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */. T* z& G/ c4 S5 j' i
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
2 w+ o# E, T# R3 v$ aMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);& D; `6 L7 n& X- j" Y  Y
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
' ~) n( r6 K5 L7 u# W}
3 z( t+ v- w' g  d! U
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

, R9 ^, D2 b, H! A' r
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