MCASP自环配置。

wapdasta

我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA，所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。

部分代码如下

input mcasp_afsx,
6 o2 Q! r% R" I% H( x8 i/ \input mcasp_ahclkx,
input mcasp_aclkx,
input axr0,
0 ^% ?' V+ H- p  X4 m  s
$ _% h5 g! ^( C% p6 ]% `output mcasp_afsr,
4 A! B" K5 {; p- H% Ioutput mcasp_ahclkr,
2 Y2 ], E7 S4 Boutput mcasp_aclkr,
output axr1,
+ G. P, W( |1 n

assign mcasp_afsr = mcasp_afsx;
assign mcasp_aclkr = mcasp_aclkx;
/ q- k$ e- d: y+ ]) Z! e. gassign mcasp_ahclkr = mcasp_ahclkx;
0 c$ n8 o" ^+ Eassign axr1 = axr0;

! `7 L% P5 X. P4 M5 H. r/ k5 Q, a1 ?6 I, y
! ^8 k. }% K, q' I8 t% O

在OMAPL138这端，通过axr0接口发固定的数，axr1接收。

在配置MACASP的时候，发送全部取内部时钟，接收全部取外部时钟。

一直循环发送，但是接收不到。在FPGA端也没有看到时钟和信号的波形。

部分代码如下，关于edma3的部分未做变化。

static void McASPI2SConfigure(void)
{
7 _1 }) r) f+ {' e0 Y% E' s- [9 ~McASPRxReset(SOC_MCASP_0_CTRL_REGS);
McASPTxReset(SOC_MCASP_0_CTRL_REGS);

/* Enable the FIFOs for DMA transfer */
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);

/* Set I2S format in the transmitter/receiver format units */
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
MCASP_RX_MODE_DMA);
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
8 I6 n$ T4 `/ J6 d  H# JMCASP_TX_MODE_DMA);

/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
5 r% s9 \. ]: }) N! [/ ZMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);

/* configure the clock for receiver */
- R9 }' }* _% ]McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
; j- H7 M# ^! j: w/ Q- ^0x00, 0xFF);

/* configure the clock for transmitter */
2 u5 u: }0 _* W$ Y% gMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
$ K* T8 W! Z% u2 }McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
0x00, 0xFF);

7 o  i/ r; U, {3 C/* Enable synchronization of RX and TX sections */
) t" Z/ K0 O; g3 `2 DMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);

/* Enable the transmitter/receiver slots. I2S uses 2 slots */
7 d2 E% H- g4 }1 q2 C4 jMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
& F- K4 `+ l; L( }, IMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);

/*
** Set the serializers, Currently only one serializer is set as
** transmitter and one serializer as receiver.
8 W5 T7 k$ |9 g' D2 Q; w' i% b$ i*/
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);

/*
5 o; z$ K; o/ ^* P% k** Configure the McASP pins
8 e0 b) o3 r* _- E** Input - Frame Sync, Clock and Serializer Rx
** Output - Serializer Tx is connected to the input of the codec
+ \, u" U. }/ a( [* C*/
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
" |7 q1 f8 N( b( E5 g. @! kMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
| MCASP_PIN_ACLKX
| MCASP_PIN_AHCLKX
0 F: R5 q" w2 r4 @7 f: k. t  i| MCASP_PIN_AXR(MCASP_XSER_RX));

/* Enable error interrupts for McASP */
, \" Z' _$ L; Q- n4 S5 a& L+ fMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
8 K" }2 v$ D  k+ K8 f, W| MCASP_TX_CLKFAIL
3 K% Y9 V8 a+ E, T| MCASP_TX_SYNCERROR
| MCASP_TX_UNDERRUN);

McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
% y* H( r1 r9 K& z5 ^" ?| MCASP_RX_CLKFAIL
* Y$ ?- P" t4 _) i| MCASP_RX_SYNCERROR
| MCASP_RX_OVERRUN);
}

static void I2SDataTxRxActivate(void)
' V4 J+ q8 |: O! m{
! Q& a. s0 ?9 b) u$ W6 F. Y$ [* b/ z/* Start the clocks */
4 W2 i: W2 [0 c( Y+ i1 K- uMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);

/* Enable EDMA for the transfer */
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
) Z) X/ e# Z9 z* U9 o+ U2 Z# k7 TEDMA3_TRIG_MODE_EVENT);
" A) C) Q+ |, j" ~) L9 m; Y% SEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
- ~0 s0 K7 j6 @9 k) h( x4 H1 hEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);

/* Activate the serializers */
8 ?2 H) h& Y+ l& JMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);

/* make sure that the XDATA bit is cleared to zero */
& |2 j6 t2 V& z1 ]3 dwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);

/* Activate the state machines */
) z& ]- t( G$ h# GMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
5 `5 R2 L: n5 l* T5 s' w/ wMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
1 I1 j+ J; a5 @7 C% A& {}

请问：问题出在哪了，时钟按照这样配是否有错。

另外我看XDATA一直是0，接收的rxbuf0,1,2里有一般全是FFFF一半全是0.