MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
4 m6 q- H8 s* k' X3 Oinput mcasp_ahclkx,
$ B, L; a  W* m0 einput mcasp_aclkx,5 h6 V7 u3 u: c0 }+ i
input axr0,
. Q" L' p4 J: @
- Y  w% w) t. A; w1 Youtput mcasp_afsr,( i; X1 t. m5 U4 L5 N
output mcasp_ahclkr,
5 K9 w" S/ M( A* J; S' {9 L- xoutput mcasp_aclkr,5 J: m1 I. w8 F2 }6 l* L
output axr1,. t* A) d- }# k! n! R
assign mcasp_afsr = mcasp_afsx;6 l, `  D1 k! o
assign mcasp_aclkr = mcasp_aclkx;
0 u. b- ~4 D2 }8 B  P) wassign mcasp_ahclkr = mcasp_ahclkx;' X5 o0 T5 h) R; H
assign axr1 = axr0;
; K. d0 ?* {6 x
' x2 M: i; f! G$ y) j6 q
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
* Z$ d' h( _  H8 L" K3 Q
static void McASPI2SConfigure(void)
) W. ]& e" I( V, F- Y# v2 w& v- h0 O{. ^, x. g! C: k% ^7 x1 ?* s5 X
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
7 `8 D& e5 b+ h  ?; m% H; NMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
& j! ?+ h8 k- d$ c" T1 MMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
' e) h2 z: m2 k8 V6 Q' n( tMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */" }2 ?5 p* s+ H, J' O  L" Y) [) t; n! ]
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
: B9 I/ F$ e( w  h' qMCASP_RX_MODE_DMA);
- S% T; E) d# E" w5 c# L0 \McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,: v' J- x# i& @1 c( q
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */' G( d$ @9 X7 F
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 3 T3 ]* a. B/ h; C
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);7 F5 b/ A& O8 r+ b: n- |
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, , X7 {; p7 Y" X; M5 D/ M: k
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
. r$ z. _% _  H; h. vMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);& z; ^8 F3 _$ s- a
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
/ G* @3 x3 r5 [  c/ n, p3 YMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
5 r  W- ]+ g" U1 d. V0x00, 0xFF);
/* configure the clock for transmitter */' D. ^2 i. _" T/ ?+ X3 s% Y2 T9 i) e+ y
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);6 d4 F# H0 v( u* c: ^% M7 N0 {  t
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); # t- [9 _3 T) b, \& R8 [9 m
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
) g) S# F7 S; _/ S  S' Y( Z# R6 e6 S0x00, 0xFF);8 ~! ^5 d* K5 }

( V4 t1 d8 D8 j, b/* Enable synchronization of RX and TX sections */ 2 n0 E+ i/ z, [: j. U' r& D6 D
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */( Y- C$ O0 s- m7 v  Y
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
2 V/ j7 C- R8 q, p$ eMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
5 C1 w7 Q3 w# H& ~** Set the serializers, Currently only one serializer is set as
+ N- i' R" O& U5 I% U** transmitter and one serializer as receiver." z) l& w$ T" z( x7 w5 ]
*/
. H6 K4 w/ u, c. t4 ~3 o3 TMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
- B' N+ k! L* `! H; |4 D, I* d. GMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*. s+ l* p. F4 p, N
** Configure the McASP pins 4 B2 I$ F4 O3 @$ V
** Input - Frame Sync, Clock and Serializer Rx
2 z# M6 ]/ ?! |( x0 |, Y) C" Q6 z** Output - Serializer Tx is connected to the input of the codec
5 F' h$ ?& N2 U/ u4 Y: i& O*/+ ], M9 n  |) \4 \
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
- p7 y3 e7 N" [2 C" eMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));2 V/ r0 }( q9 ]/ w' b" r; C
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
, B- R5 t) n- ^1 T* a| MCASP_PIN_ACLKX% [- t) j! l, l3 W1 k0 R  E
| MCASP_PIN_AHCLKX9 h8 G+ ^' ?7 V5 d" N4 F/ g3 e: r' l
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */; B2 d$ B$ T2 _9 ^4 k7 k( Q; i- F6 `
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
; ~; v( P5 m( ]1 \( y, i, @| MCASP_TX_CLKFAIL
$ R6 j2 }. T) k" T. G6 M3 B$ h| MCASP_TX_SYNCERROR8 ~9 b* ~/ @- W0 L
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR   v. u# g* l. s0 S# q/ a
| MCASP_RX_CLKFAIL1 v) W8 M6 I2 g9 n; ~; e0 Z
| MCASP_RX_SYNCERROR
! `* k: B; r0 @  P& W| MCASP_RX_OVERRUN);6 ^8 f, A, s2 t- ^3 m
}
static void I2SDataTxRxActivate(void)# u5 ^) n% c4 u7 y% y! c/ _. w" E
{* ]0 F! b2 c' Y' V) o
/* Start the clocks */
. t( B; S4 S+ u  g  MMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
  I! o+ G* I/ V( h, V3 j. NMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
, X" [; t0 b" L' t4 C1 D+ ~& FEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,7 C- ?1 N+ H: i/ j8 c, |
EDMA3_TRIG_MODE_EVENT);5 E  X  ~0 h: l! P
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
/ m2 S) h' O+ Q( NEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
4 c- p6 J# Y$ g. l" f: n" O. EMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);8 B, N3 A, j' H) h7 s! u& A
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */& E5 w7 u) p& i3 A7 v  }- k
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
0 G/ `% F3 u$ `7 X' _9 V6 YMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
/ b) G$ V6 z; a4 [7 Z$ iMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);2 q  k- k, }: G5 q1 c& g
}

( U/ L* l/ ?4 c# c* y& ]
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

2 a* K& \  l: P) z! b3 C
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