MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,9 K. X0 m8 l0 V+ u" o" E% J
input mcasp_ahclkx,$ U6 K6 c9 O6 M
input mcasp_aclkx,
* o* p1 }* u& ]& o+ ]% E0 T2 e- h  N. tinput axr0,
7 Z* I; G1 S4 c0 ?+ v3 X$ q- t) d2 E9 ]
output mcasp_afsr,; \' [0 |# @3 E" h& B
output mcasp_ahclkr,3 I/ E5 D+ }7 \/ C2 W
output mcasp_aclkr,
: j6 p, x. W+ K( q: _& ]& R" X7 goutput axr1,! T& ~" t; `( W) C3 \
assign mcasp_afsr = mcasp_afsx;; C% R! x" i: [. q2 ?5 s8 d
assign mcasp_aclkr = mcasp_aclkx;
6 Z+ g! G" G( I# \( `- Wassign mcasp_ahclkr = mcasp_ahclkx;! a* u2 R5 Q' b+ I& _. B
assign axr1 = axr0;
2 N" d+ U( k' W" {2 h

5 u, p5 ~  \- R( e8 Z: [8 S+ Z
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
" {! u9 N/ ^% N3 _4 O% }! b  h
static void McASPI2SConfigure(void)7 F# D* H7 X5 h1 ?3 l
{
8 f; p" g( n, `1 lMcASPRxReset(SOC_MCASP_0_CTRL_REGS);+ b7 n3 Z9 L6 w, L
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */- e5 X* R' W, d7 d. }" L
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
) ^8 l) O+ n% c! L4 G- s/ ZMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */2 u5 q3 D% t. `# W8 v+ y6 [
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,( l- Z) P9 r2 o7 k. q
MCASP_RX_MODE_DMA);; i, v- X! {, \
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
0 n: G  _9 C5 t$ GMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
( `+ Z" c# L4 @: j3 SMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, - [0 a7 E" A& E
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);' u! s: Q+ G- `5 D
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
- h5 o2 |4 j: U9 B* lMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */" o4 X0 d% }- B' `
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
6 Q) Q1 k! N3 e& _) RMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); + M+ k# S( o& i1 l' {6 o
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
/ L  |& d8 x! _+ S& E) F! x# [' m& K$ q5 I0x00, 0xFF);
/* configure the clock for transmitter */
5 r' `  |! W- R) {" r+ X: |McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);. f3 _! y* T5 L, R
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
0 v* A( {2 e% w3 M' a1 DMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
+ k/ d/ Q, n! x0x00, 0xFF);
; b1 O2 j  n, R
) {! [' ^. h& q3 N$ t/* Enable synchronization of RX and TX sections */
) L  W/ @/ ?8 l, E; Y# Z' M; I' JMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */2 ~" [! B5 s! r% Z+ C' Y) B. \( G
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);; j7 s# B) c" `; u/ Z" _6 T4 }( e
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*3 s+ K7 F4 P! i
** Set the serializers, Currently only one serializer is set as# v1 S8 k+ c9 n3 K0 g4 |
** transmitter and one serializer as receiver.
( J+ i8 o- [. i0 d7 j& P*/! N. d- w' ]: |. k  H
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);2 Q( Q& @- s( D2 C
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*& V- U/ k7 r: B" ?( V
** Configure the McASP pins
$ h4 A+ M. X. Z, h$ {' R: L" E** Input - Frame Sync, Clock and Serializer Rx
3 i, J/ J4 B' N  j; d** Output - Serializer Tx is connected to the input of the codec 1 y! F- O5 T4 X1 W% w; Z* o
*/
5 N9 V3 P1 _4 W0 c; RMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);& x+ x2 ]/ q( B6 F. l, f
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));2 z( e9 _. u0 s" O* ?
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX2 x# B- R" g2 K" `/ d
| MCASP_PIN_ACLKX
# z* Q; g2 n' w- }| MCASP_PIN_AHCLKX/ {% M  W/ U1 W  Q
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */* t' L& V( I" @+ D+ j2 D, A
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
! u0 k' V2 f2 i4 l( I$ L" u* l) y- h| MCASP_TX_CLKFAIL + Q% h) @% Y0 ]* z" Y- ~
| MCASP_TX_SYNCERROR& q; ?# Z% }4 s* _  ^" J
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR , X; \1 P! u$ _0 y2 E
| MCASP_RX_CLKFAIL
5 B  b  b4 R1 L8 K| MCASP_RX_SYNCERROR 8 @. K  Z9 f4 K! ]
| MCASP_RX_OVERRUN);
# _" Q" G4 {( E  n}
static void I2SDataTxRxActivate(void)
: D- o" Y+ B% P: s+ f# d4 b{+ o, O) h+ p* W/ M- M
/* Start the clocks */
8 a4 u1 c/ [8 w$ n/ hMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
0 ~. m: Y0 x0 a2 ~McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
; z/ s% D3 W# |8 U0 c0 [2 nEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
+ `/ B8 K& P, u9 b- cEDMA3_TRIG_MODE_EVENT);& J; t9 p" w6 N+ y/ l6 \6 \8 X. b
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
' a- q- M5 o9 o+ y. W% C3 vEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
- Y; K7 B" l+ f8 ^% B( ZMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
! e9 [  V+ u, \) s  MMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */6 s. N: S1 J3 c0 x, J6 @9 N
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */( l7 T$ N- h( s2 _  W
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);; h6 z% f$ _' C% \* k! S
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
/ M! g8 U, i: V' _}
. |1 z- w' X5 v: y$ h1 z
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
0 D' E- X% S/ G* a5 e
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